Tests for extsb, extsh, extsw.
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a5483ced29
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cfaa72cae6
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test_extsb_1:
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#_ REGISTER_IN r4 0x0F
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extsb r3, r4
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blr
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test_extsb_1_constant:
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li r4, 0x0F
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extsb r3, r4
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blr
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#_ REGISTER_OUT r3 0x0F
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#_ REGISTER_OUT r4 0x0F
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test_extsb_2:
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#_ REGISTER_IN r4 0x7F
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extsb r3, r4
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blr
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#_ REGISTER_OUT r3 0x7F
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#_ REGISTER_OUT r4 0x7F
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test_extsb_2_constant:
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li r4, 0x7F
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extsb r3, r4
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blr
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#_ REGISTER_OUT r3 0x7F
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#_ REGISTER_OUT r4 0x7F
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test_extsb_3:
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#_ REGISTER_IN r4 0x80
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extsb r3, r4
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blr
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#_ REGISTER_OUT r3 0xFFFFFFFFFFFFFF80
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#_ REGISTER_OUT r4 0x80
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test_extsb_3_constant:
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li r4, 0x80
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extsb r3, r4
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blr
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#_ REGISTER_OUT r3 0xFFFFFFFFFFFFFF80
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#_ REGISTER_OUT r4 0x80
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test_extsb_4:
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#_ REGISTER_IN r4 0xFFFFFFFFFFFFF080
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extsb r3, r4
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blr
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#_ REGISTER_OUT r3 0xFFFFFFFFFFFFFF80
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#_ REGISTER_OUT r4 0xFFFFFFFFFFFFF080
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test_extsb_4_constant:
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li r4, 0xF7F
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not r4, r4
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extsb r3, r4
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blr
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#_ REGISTER_OUT r3 0xFFFFFFFFFFFFFF80
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#_ REGISTER_OUT r4 0xFFFFFFFFFFFFF080
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test_extsb_cr_1:
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extsb. r3, r4
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mfcr r12
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blr
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#_ REGISTER_OUT r3 0x0F
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#_ REGISTER_OUT r4 0x0F
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#_ REGISTER_OUT r12 0x40000000
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test_extsb_cr_1_constant:
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li r4, 0x0F
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extsb. r3, r4
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mfcr r12
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blr
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#_ REGISTER_OUT r3 0x0F
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#_ REGISTER_OUT r4 0x0F
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#_ REGISTER_OUT r12 0x40000000
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test_extsb_cr_2:
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#_ REGISTER_IN r4 0x7F
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extsb. r3, r4
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mfcr r12
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blr
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#_ REGISTER_OUT r3 0x7F
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||||||
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#_ REGISTER_OUT r4 0x7F
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||||||
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#_ REGISTER_OUT r12 0x40000000
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||||||
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test_extsb_cr_2_constant:
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li r4, 0x7F
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extsb. r3, r4
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mfcr r12
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blr
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||||||
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#_ REGISTER_OUT r3 0x7F
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#_ REGISTER_OUT r4 0x7F
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#_ REGISTER_OUT r12 0x40000000
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test_extsb_cr_3:
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#_ REGISTER_IN r4 0x80
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extsb. r3, r4
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mfcr r12
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blr
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#_ REGISTER_OUT r3 0xFFFFFFFFFFFFFF80
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#_ REGISTER_OUT r4 0x80
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#_ REGISTER_OUT r12 0x80000000
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test_extsb_cr_3_constant:
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|
li r4, 0x80
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extsb. r3, r4
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mfcr r12
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blr
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#_ REGISTER_OUT r3 0xFFFFFFFFFFFFFF80
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#_ REGISTER_OUT r4 0x80
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#_ REGISTER_OUT r12 0x80000000
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||||||
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test_extsb_cr_4:
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#_ REGISTER_IN r4 0xFFFFFFFFFFFFF080
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extsb. r3, r4
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|
mfcr r12
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blr
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||||||
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#_ REGISTER_OUT r3 0xFFFFFFFFFFFFFF80
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||||||
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#_ REGISTER_OUT r4 0xFFFFFFFFFFFFF080
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||||||
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#_ REGISTER_OUT r12 0x80000000
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||||||
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test_extsb_cr_4_constant:
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li r4, 0xF7F
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not r4, r4
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extsb. r3, r4
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mfcr r12
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blr
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#_ REGISTER_OUT r3 0xFFFFFFFFFFFFFF80
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#_ REGISTER_OUT r4 0xFFFFFFFFFFFFF080
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#_ REGISTER_OUT r12 0x80000000
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@ -0,0 +1,133 @@
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test_extsh_1:
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#_ REGISTER_IN r4 0x0F
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extsh r3, r4
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blr
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#_ REGISTER_OUT r3 0x0F
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#_ REGISTER_OUT r4 0x0F
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test_extsh_1_constant:
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li r4, 0x0F
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|
extsh r3, r4
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|
blr
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||||||
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#_ REGISTER_OUT r3 0x0F
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||||||
|
#_ REGISTER_OUT r4 0x0F
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||||||
|
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||||||
|
test_extsh_2:
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#_ REGISTER_IN r4 0x7FFF
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|
extsh r3, r4
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|
blr
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||||||
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#_ REGISTER_OUT r3 0x7FFF
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||||||
|
#_ REGISTER_OUT r4 0x7FFF
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||||||
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||||||
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test_extsh_2_constant:
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|
li r4, 0x7FFF
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||||||
|
extsh r3, r4
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|
blr
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||||||
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#_ REGISTER_OUT r3 0x7FFF
|
||||||
|
#_ REGISTER_OUT r4 0x7FFF
|
||||||
|
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||||||
|
test_extsh_3:
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#_ REGISTER_IN r4 0x8000
|
||||||
|
extsh r3, r4
|
||||||
|
blr
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||||||
|
#_ REGISTER_OUT r3 0xFFFFFFFFFFFF8000
|
||||||
|
#_ REGISTER_OUT r4 0x8000
|
||||||
|
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||||||
|
test_extsh_3_constant:
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||||||
|
li r4, 0x80
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sldi r4, r4, 8
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|
extsh r3, r4
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||||||
|
blr
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||||||
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#_ REGISTER_OUT r3 0xFFFFFFFFFFFF8000
|
||||||
|
#_ REGISTER_OUT r4 0x8000
|
||||||
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test_extsh_4:
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#_ REGISTER_IN r4 0xFFFFFFFFFFF08000
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|
extsh r3, r4
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|
blr
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||||||
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#_ REGISTER_OUT r3 0xFFFFFFFFFFFF8000
|
||||||
|
#_ REGISTER_OUT r4 0xFFFFFFFFFFF08000
|
||||||
|
|
||||||
|
test_extsh_4_constant:
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|
li r4, 0xF7F
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||||||
|
not r4, r4
|
||||||
|
sldi r4, r4, 8
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||||||
|
extsh r3, r4
|
||||||
|
blr
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||||||
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#_ REGISTER_OUT r3 0xFFFFFFFFFFFF8000
|
||||||
|
#_ REGISTER_OUT r4 0xFFFFFFFFFFF08000
|
||||||
|
|
||||||
|
test_extsh_cr_1:
|
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#_ REGISTER_IN r4 0x0F
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extsh. r3, r4
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||||||
|
mfcr r12
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blr
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||||||
|
#_ REGISTER_OUT r3 0x0F
|
||||||
|
#_ REGISTER_OUT r4 0x0F
|
||||||
|
#_ REGISTER_OUT r12 0x40000000
|
||||||
|
|
||||||
|
test_extsh_cr_1_constant:
|
||||||
|
li r4, 0x0F
|
||||||
|
extsh. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
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||||||
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#_ REGISTER_OUT r3 0x0F
|
||||||
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#_ REGISTER_OUT r4 0x0F
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||||||
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#_ REGISTER_OUT r12 0x40000000
|
||||||
|
|
||||||
|
test_extsh_cr_2:
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||||||
|
#_ REGISTER_IN r4 0x7FFF
|
||||||
|
extsh. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0x7FFF
|
||||||
|
#_ REGISTER_OUT r4 0x7FFF
|
||||||
|
#_ REGISTER_OUT r12 0x40000000
|
||||||
|
|
||||||
|
test_extsh_cr_2_constant:
|
||||||
|
li r4, 0x7FFF
|
||||||
|
extsh. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0x7FFF
|
||||||
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#_ REGISTER_OUT r4 0x7FFF
|
||||||
|
#_ REGISTER_OUT r12 0x40000000
|
||||||
|
|
||||||
|
test_extsh_cr_3:
|
||||||
|
#_ REGISTER_IN r4 0x8000
|
||||||
|
extsh. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0xFFFFFFFFFFFF8000
|
||||||
|
#_ REGISTER_OUT r4 0x8000
|
||||||
|
#_ REGISTER_OUT r12 0x80000000
|
||||||
|
|
||||||
|
test_extsh_cr_3_constant:
|
||||||
|
li r4, 0x80
|
||||||
|
sldi r4, r4, 8
|
||||||
|
extsh. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0xFFFFFFFFFFFF8000
|
||||||
|
#_ REGISTER_OUT r4 0x8000
|
||||||
|
#_ REGISTER_OUT r12 0x80000000
|
||||||
|
|
||||||
|
test_extsh_cr_4:
|
||||||
|
#_ REGISTER_IN r4 0xFFFFFFFFFFF08000
|
||||||
|
extsh. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0xFFFFFFFFFFFF8000
|
||||||
|
#_ REGISTER_OUT r4 0xFFFFFFFFFFF08000
|
||||||
|
#_ REGISTER_OUT r12 0x80000000
|
||||||
|
|
||||||
|
test_extsh_cr_4_constant:
|
||||||
|
li r4, 0xF7F
|
||||||
|
not r4, r4
|
||||||
|
sldi r4, r4, 8
|
||||||
|
extsh. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0xFFFFFFFFFFFF8000
|
||||||
|
#_ REGISTER_OUT r4 0xFFFFFFFFFFF08000
|
||||||
|
#_ REGISTER_OUT r12 0x80000000
|
||||||
|
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@ -0,0 +1,135 @@
|
||||||
|
test_extsw_1:
|
||||||
|
#_ REGISTER_IN r4 0x0F
|
||||||
|
extsw r3, r4
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0x0F
|
||||||
|
#_ REGISTER_OUT r4 0x0F
|
||||||
|
|
||||||
|
test_extsw_1_constant:
|
||||||
|
li r4, 0x0F
|
||||||
|
extsw r3, r4
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0x0F
|
||||||
|
#_ REGISTER_OUT r4 0x0F
|
||||||
|
|
||||||
|
test_extsw_2:
|
||||||
|
#_ REGISTER_IN r4 0x7FFFFFFF
|
||||||
|
extsw r3, r4
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0x7FFFFFFF
|
||||||
|
#_ REGISTER_OUT r4 0x7FFFFFFF
|
||||||
|
|
||||||
|
test_extsw_2_constant:
|
||||||
|
lis r4, 0x7FFF
|
||||||
|
ori r4, r4, 0xFFFF
|
||||||
|
extsw r3, r4
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0x7FFFFFFF
|
||||||
|
#_ REGISTER_OUT r4 0x7FFFFFFF
|
||||||
|
|
||||||
|
test_extsw_3:
|
||||||
|
#_ REGISTER_IN r4 0x80000000
|
||||||
|
extsw r3, r4
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0xFFFFFFFF80000000
|
||||||
|
#_ REGISTER_OUT r4 0x80000000
|
||||||
|
|
||||||
|
test_extsw_3_constant:
|
||||||
|
li r4, 0x80
|
||||||
|
sldi r4, r4, 24
|
||||||
|
extsw r3, r4
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0xFFFFFFFF80000000
|
||||||
|
#_ REGISTER_OUT r4 0x80000000
|
||||||
|
|
||||||
|
test_extsw_4:
|
||||||
|
#_ REGISTER_IN r4 0xFFFFFFF080000000
|
||||||
|
extsw r3, r4
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0xFFFFFFFF80000000
|
||||||
|
#_ REGISTER_OUT r4 0xFFFFFFF080000000
|
||||||
|
|
||||||
|
test_extsw_4_constant:
|
||||||
|
li r4, 0xF7F
|
||||||
|
not r4, r4
|
||||||
|
sldi r4, r4, 24
|
||||||
|
extsw r3, r4
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0xFFFFFFFF80000000
|
||||||
|
#_ REGISTER_OUT r4 0xFFFFFFF080000000
|
||||||
|
|
||||||
|
test_extsw_cr_1:
|
||||||
|
#_ REGISTER_IN r4 0x0F
|
||||||
|
extsw. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0x0F
|
||||||
|
#_ REGISTER_OUT r4 0x0F
|
||||||
|
#_ REGISTER_OUT r12 0x40000000
|
||||||
|
|
||||||
|
test_extsw_cr_1_constant:
|
||||||
|
li r4, 0x0F
|
||||||
|
extsw. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0x0F
|
||||||
|
#_ REGISTER_OUT r4 0x0F
|
||||||
|
#_ REGISTER_OUT r12 0x40000000
|
||||||
|
|
||||||
|
test_extsw_cr_2:
|
||||||
|
#_ REGISTER_IN r4 0x7FFFFFFF
|
||||||
|
extsw. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0x7FFFFFFF
|
||||||
|
#_ REGISTER_OUT r4 0x7FFFFFFF
|
||||||
|
#_ REGISTER_OUT r12 0x40000000
|
||||||
|
|
||||||
|
test_extsw_cr_2_constant:
|
||||||
|
lis r4, 0x7FFF
|
||||||
|
ori r4, r4, 0xFFFF
|
||||||
|
extsw. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0x7FFFFFFF
|
||||||
|
#_ REGISTER_OUT r4 0x7FFFFFFF
|
||||||
|
#_ REGISTER_OUT r12 0x40000000
|
||||||
|
|
||||||
|
test_extsw_cr_3:
|
||||||
|
#_ REGISTER_IN r4 0x80000000
|
||||||
|
extsw. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0xFFFFFFFF80000000
|
||||||
|
#_ REGISTER_OUT r4 0x80000000
|
||||||
|
#_ REGISTER_OUT r12 0x80000000
|
||||||
|
|
||||||
|
test_extsw_cr_3_constant:
|
||||||
|
li r4, 0x80
|
||||||
|
sldi r4, r4, 24
|
||||||
|
extsw. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0xFFFFFFFF80000000
|
||||||
|
#_ REGISTER_OUT r4 0x80000000
|
||||||
|
#_ REGISTER_OUT r12 0x80000000
|
||||||
|
|
||||||
|
test_extsw_cr_4:
|
||||||
|
#_ REGISTER_IN r4 0xFFFFFFF080000000
|
||||||
|
extsw. r3, r4
|
||||||
|
mfcr r12
|
||||||
|
blr
|
||||||
|
#_ REGISTER_OUT r3 0xFFFFFFFF80000000
|
||||||
|
#_ REGISTER_OUT r4 0xFFFFFFF080000000
|
||||||
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#_ REGISTER_OUT r12 0x80000000
|
||||||
|
|
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test_extsw_cr_4_constant:
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li r4, 0xF7F
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not r4, r4
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sldi r4, r4, 24
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extsw. r3, r4
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mfcr r12
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blr
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#_ REGISTER_OUT r3 0xFFFFFFFF80000000
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#_ REGISTER_OUT r4 0xFFFFFFF080000000
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#_ REGISTER_OUT r12 0x80000000
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