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DS I/O: Add DMA FILL registers
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793cad8f30
commit
37f1105fd9
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@ -38,6 +38,14 @@ enum DSIORegisters {
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DS_REG_DMA3DAD_HI = 0x0DA,
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DS_REG_DMA3CNT_LO = 0x0DC,
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||||
DS_REG_DMA3CNT_HI = 0x0DE,
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||||
DS_REG_DMA0FILL_LO = 0x0E0,
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||||
DS_REG_DMA0FILL_HI = 0x0E2,
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||||
DS_REG_DMA1FILL_LO = 0x0E4,
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||||
DS_REG_DMA1FILL_HI = 0x0E6,
|
||||
DS_REG_DMA2FILL_LO = 0x0E8,
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||||
DS_REG_DMA2FILL_HI = 0x0EA,
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||||
DS_REG_DMA3FILL_LO = 0x0EC,
|
||||
DS_REG_DMA3FILL_HI = 0x0EE,
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||||
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||||
// Timers
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||||
DS_REG_TM0CNT_LO = 0x100,
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||||
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27
src/ds/io.c
27
src/ds/io.c
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@ -29,6 +29,17 @@ static void _DSHaltCNT(struct DSCommon* dscore, uint8_t value) {
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static uint32_t DSIOWrite(struct DSCommon* dscore, uint32_t address, uint16_t value) {
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||||
switch (address) {
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// DMA Fill
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case DS_REG_DMA0FILL_LO:
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||||
case DS_REG_DMA0FILL_HI:
|
||||
case DS_REG_DMA1FILL_LO:
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||||
case DS_REG_DMA1FILL_HI:
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||||
case DS_REG_DMA2FILL_LO:
|
||||
case DS_REG_DMA2FILL_HI:
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||||
case DS_REG_DMA3FILL_LO:
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||||
case DS_REG_DMA3FILL_HI:
|
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break;
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// Timers
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case DS_REG_TM0CNT_LO:
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GBATimerWriteTMCNT_LO(&dscore->timers[0], value);
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@ -202,6 +213,14 @@ uint16_t DS7IORead(struct DS* ds, uint32_t address) {
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case DS_REG_TM3CNT_LO:
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||||
DSIOUpdateTimer(&ds->ds7, address);
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||||
break;
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case DS_REG_DMA0FILL_LO:
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case DS_REG_DMA0FILL_HI:
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case DS_REG_DMA1FILL_LO:
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case DS_REG_DMA1FILL_HI:
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case DS_REG_DMA2FILL_LO:
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case DS_REG_DMA2FILL_HI:
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||||
case DS_REG_DMA3FILL_LO:
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case DS_REG_DMA3FILL_HI:
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||||
case DS_REG_TM0CNT_HI:
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case DS_REG_TM1CNT_HI:
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case DS_REG_TM2CNT_HI:
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@ -333,6 +352,14 @@ uint16_t DS9IORead(struct DS* ds, uint32_t address) {
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|||
case DS_REG_TM3CNT_LO:
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||||
DSIOUpdateTimer(&ds->ds9, address);
|
||||
break;
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case DS_REG_DMA0FILL_LO:
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case DS_REG_DMA0FILL_HI:
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case DS_REG_DMA1FILL_LO:
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case DS_REG_DMA1FILL_HI:
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case DS_REG_DMA2FILL_LO:
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case DS_REG_DMA2FILL_HI:
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case DS_REG_DMA3FILL_LO:
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case DS_REG_DMA3FILL_HI:
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case DS_REG_TM0CNT_HI:
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case DS_REG_TM1CNT_HI:
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case DS_REG_TM2CNT_HI:
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