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moved PCI init to BIOS - added ISA memory mapping registers and SMM support
git-svn-id: svn://svn.savannah.nongnu.org/qemu/trunk@2174 c046a42c-6fe2-441c-8c8c-71466251a162
This commit is contained in:
bellard
parent
02a1602e62
commit
ee0ea1d0dd
348
hw/piix_pci.c
348
hw/piix_pci.c
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|
@ -52,7 +52,123 @@ static int pci_slot_get_pirq(PCIDevice *pci_dev, int irq_num)
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return (irq_num + slot_addend) & 3;
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return (irq_num + slot_addend) & 3;
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||||||
}
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}
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||||||
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||||||
PCIBus *i440fx_init(void)
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static uint32_t isa_page_descs[384 / 4];
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static uint8_t smm_enabled;
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static const uint32_t mar_addresses[15] = {
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0xa0000,
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0xc0000,
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0xc4000,
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||||||
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0xc8000,
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||||||
|
0xcc000,
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||||||
|
0xd0000,
|
||||||
|
0xd4000,
|
||||||
|
0xd8000,
|
||||||
|
0xdc000,
|
||||||
|
0xe0000,
|
||||||
|
0xe4000,
|
||||||
|
0xe8000,
|
||||||
|
0xec000,
|
||||||
|
0xf0000,
|
||||||
|
0x100000,
|
||||||
|
};
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||||||
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||||||
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static void i440fx_update_memory_mappings(PCIDevice *d)
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{
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int i, r;
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uint32_t start, end, addr;
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uint32_t smram, smbase, smsize;
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for(i = 0; i < 14; i++) {
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||||||
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r = (d->config[(i >> 1) + 0x61] >> ((i & 1) * 4)) & 3;
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||||||
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start = mar_addresses[i];
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||||||
|
end = mar_addresses[i + 1];
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||||||
|
// printf("ISA mapping %08x: %d\n", start, r);
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||||||
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switch(r) {
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||||||
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case 3:
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||||||
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/* RAM */
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||||||
|
cpu_register_physical_memory(start, end - start,
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||||||
|
start);
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||||||
|
break;
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||||||
|
case 2:
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||||||
|
/* ROM (XXX: not quite correct) */
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||||||
|
cpu_register_physical_memory(start, end - start,
|
||||||
|
start | IO_MEM_ROM);
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||||||
|
break;
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||||||
|
case 1:
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||||||
|
case 0:
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||||||
|
/* XXX: should distinguish read/write cases */
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||||||
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for(addr = start; addr < end; addr += 4096) {
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||||||
|
cpu_register_physical_memory(addr, 4096,
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||||||
|
isa_page_descs[(addr - 0xa0000) >> 12]);
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}
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||||||
|
break;
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||||||
|
}
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||||||
|
}
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||||||
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smram = le32_to_cpu(*(uint32_t *)(d->config + 0x6c));
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||||||
|
if ((smm_enabled && (smram & 0x80000000)) || (smram & (1 << 26))) {
|
||||||
|
/* Note: we assume the SMM area is in the 0xa0000-0x100000 range */
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||||||
|
smbase = (smram & 0xffff) << 16;
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||||||
|
smsize = (((smram >> 20) & 0xf) + 1) << 16;
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||||||
|
if (smbase >= 0xa0000 && (smbase + smsize) <= 0x100000) {
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||||||
|
cpu_register_physical_memory(smbase, smsize, smbase);
|
||||||
|
}
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||||||
|
}
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||||||
|
}
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||||||
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void i440fx_set_smm(PCIDevice *d, int val)
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||||||
|
{
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||||||
|
val = (val != 0);
|
||||||
|
if (smm_enabled != val) {
|
||||||
|
smm_enabled = val;
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||||||
|
i440fx_update_memory_mappings(d);
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||||||
|
}
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||||||
|
}
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||||||
|
/* XXX: suppress when better memory API. We make the assumption that
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|
no device (in particular the VGA) changes the memory mappings in
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||||||
|
the 0xa0000-0x100000 range */
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||||||
|
void i440fx_init_memory_mappings(PCIDevice *d)
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||||||
|
{
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||||||
|
int i;
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||||||
|
for(i = 0; i < 96; i++) {
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||||||
|
isa_page_descs[i] = cpu_get_physical_page_desc(0xa0000 + i * 0x1000);
|
||||||
|
}
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||||||
|
}
|
||||||
|
|
||||||
|
static void i440fx_write_config(PCIDevice *d,
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|
uint32_t address, uint32_t val, int len)
|
||||||
|
{
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||||||
|
/* XXX: implement SMRAM.D_LOCK */
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||||||
|
pci_default_write_config(d, address, val, len);
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||||||
|
if ((address >= 0x61 && address <= 0x67) || address == 0x6c)
|
||||||
|
i440fx_update_memory_mappings(d);
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||||||
|
}
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||||||
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|
||||||
|
static void i440fx_save(QEMUFile* f, void *opaque)
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||||||
|
{
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||||||
|
PCIDevice *d = opaque;
|
||||||
|
pci_device_save(d, f);
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||||||
|
qemu_put_8s(f, &smm_enabled);
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||||||
|
}
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||||||
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|
||||||
|
static int i440fx_load(QEMUFile* f, void *opaque, int version_id)
|
||||||
|
{
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||||||
|
PCIDevice *d = opaque;
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||||||
|
int ret;
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||||||
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||||||
|
if (version_id != 1)
|
||||||
|
return -EINVAL;
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||||||
|
ret = pci_device_load(d, f);
|
||||||
|
if (ret < 0)
|
||||||
|
return ret;
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||||||
|
i440fx_update_memory_mappings(d);
|
||||||
|
qemu_get_8s(f, &smm_enabled);
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
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|
||||||
|
PCIBus *i440fx_init(PCIDevice **pi440fx_state)
|
||||||
{
|
{
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||||||
PCIBus *b;
|
PCIBus *b;
|
||||||
PCIDevice *d;
|
PCIDevice *d;
|
||||||
|
|
@ -73,7 +189,7 @@ PCIBus *i440fx_init(void)
|
||||||
register_ioport_read(0xcfc, 4, 4, pci_host_data_readl, s);
|
register_ioport_read(0xcfc, 4, 4, pci_host_data_readl, s);
|
||||||
|
|
||||||
d = pci_register_device(b, "i440FX", sizeof(PCIDevice), 0,
|
d = pci_register_device(b, "i440FX", sizeof(PCIDevice), 0,
|
||||||
NULL, NULL);
|
NULL, i440fx_write_config);
|
||||||
|
|
||||||
d->config[0x00] = 0x86; // vendor_id
|
d->config[0x00] = 0x86; // vendor_id
|
||||||
d->config[0x01] = 0x80;
|
d->config[0x01] = 0x80;
|
||||||
|
|
@ -83,6 +199,11 @@ PCIBus *i440fx_init(void)
|
||||||
d->config[0x0a] = 0x00; // class_sub = host2pci
|
d->config[0x0a] = 0x00; // class_sub = host2pci
|
||||||
d->config[0x0b] = 0x06; // class_base = PCI_bridge
|
d->config[0x0b] = 0x06; // class_base = PCI_bridge
|
||||||
d->config[0x0e] = 0x00; // header_type
|
d->config[0x0e] = 0x00; // header_type
|
||||||
|
|
||||||
|
d->config[0x6c] = 0x0a; /* SMRAM */
|
||||||
|
|
||||||
|
register_savevm("I440FX", 0, 1, i440fx_save, i440fx_load, d);
|
||||||
|
*pi440fx_state = d;
|
||||||
return b;
|
return b;
|
||||||
}
|
}
|
||||||
|
|
||||||
|
|
@ -188,226 +309,3 @@ int piix3_init(PCIBus *bus)
|
||||||
piix3_reset(d);
|
piix3_reset(d);
|
||||||
return d->devfn;
|
return d->devfn;
|
||||||
}
|
}
|
||||||
|
|
||||||
/***********************************************************/
|
|
||||||
/* XXX: the following should be moved to the PC BIOS */
|
|
||||||
|
|
||||||
static __attribute__((unused)) uint32_t isa_inb(uint32_t addr)
|
|
||||||
{
|
|
||||||
return cpu_inb(NULL, addr);
|
|
||||||
}
|
|
||||||
|
|
||||||
static void isa_outb(uint32_t val, uint32_t addr)
|
|
||||||
{
|
|
||||||
cpu_outb(NULL, addr, val);
|
|
||||||
}
|
|
||||||
|
|
||||||
static __attribute__((unused)) uint32_t isa_inw(uint32_t addr)
|
|
||||||
{
|
|
||||||
return cpu_inw(NULL, addr);
|
|
||||||
}
|
|
||||||
|
|
||||||
static __attribute__((unused)) void isa_outw(uint32_t val, uint32_t addr)
|
|
||||||
{
|
|
||||||
cpu_outw(NULL, addr, val);
|
|
||||||
}
|
|
||||||
|
|
||||||
static __attribute__((unused)) uint32_t isa_inl(uint32_t addr)
|
|
||||||
{
|
|
||||||
return cpu_inl(NULL, addr);
|
|
||||||
}
|
|
||||||
|
|
||||||
static __attribute__((unused)) void isa_outl(uint32_t val, uint32_t addr)
|
|
||||||
{
|
|
||||||
cpu_outl(NULL, addr, val);
|
|
||||||
}
|
|
||||||
|
|
||||||
static uint32_t pci_bios_io_addr;
|
|
||||||
static uint32_t pci_bios_mem_addr;
|
|
||||||
/* host irqs corresponding to PCI irqs A-D */
|
|
||||||
static uint8_t pci_irqs[4] = { 11, 9, 11, 9 };
|
|
||||||
static int pci_bios_next_bus;
|
|
||||||
|
|
||||||
static void pci_config_writel(PCIDevice *d, uint32_t addr, uint32_t val)
|
|
||||||
{
|
|
||||||
PCIBus *s = d->bus;
|
|
||||||
addr |= (pci_bus_num(s) << 16) | (d->devfn << 8);
|
|
||||||
pci_data_write(s, addr, val, 4);
|
|
||||||
}
|
|
||||||
|
|
||||||
static void pci_config_writew(PCIDevice *d, uint32_t addr, uint32_t val)
|
|
||||||
{
|
|
||||||
PCIBus *s = d->bus;
|
|
||||||
addr |= (pci_bus_num(s) << 16) | (d->devfn << 8);
|
|
||||||
pci_data_write(s, addr, val, 2);
|
|
||||||
}
|
|
||||||
|
|
||||||
static void pci_config_writeb(PCIDevice *d, uint32_t addr, uint32_t val)
|
|
||||||
{
|
|
||||||
PCIBus *s = d->bus;
|
|
||||||
addr |= (pci_bus_num(s) << 16) | (d->devfn << 8);
|
|
||||||
pci_data_write(s, addr, val, 1);
|
|
||||||
}
|
|
||||||
|
|
||||||
static __attribute__((unused)) uint32_t pci_config_readl(PCIDevice *d, uint32_t addr)
|
|
||||||
{
|
|
||||||
PCIBus *s = d->bus;
|
|
||||||
addr |= (pci_bus_num(s) << 16) | (d->devfn << 8);
|
|
||||||
return pci_data_read(s, addr, 4);
|
|
||||||
}
|
|
||||||
|
|
||||||
static uint32_t pci_config_readw(PCIDevice *d, uint32_t addr)
|
|
||||||
{
|
|
||||||
PCIBus *s = d->bus;
|
|
||||||
addr |= (pci_bus_num(s) << 16) | (d->devfn << 8);
|
|
||||||
return pci_data_read(s, addr, 2);
|
|
||||||
}
|
|
||||||
|
|
||||||
static uint32_t pci_config_readb(PCIDevice *d, uint32_t addr)
|
|
||||||
{
|
|
||||||
PCIBus *s = d->bus;
|
|
||||||
addr |= (pci_bus_num(s) << 16) | (d->devfn << 8);
|
|
||||||
return pci_data_read(s, addr, 1);
|
|
||||||
}
|
|
||||||
|
|
||||||
static void pci_set_io_region_addr(PCIDevice *d, int region_num, uint32_t addr)
|
|
||||||
{
|
|
||||||
PCIIORegion *r;
|
|
||||||
uint16_t cmd;
|
|
||||||
uint32_t ofs;
|
|
||||||
|
|
||||||
if ( region_num == PCI_ROM_SLOT ) {
|
|
||||||
ofs = 0x30;
|
|
||||||
}else{
|
|
||||||
ofs = 0x10 + region_num * 4;
|
|
||||||
}
|
|
||||||
|
|
||||||
pci_config_writel(d, ofs, addr);
|
|
||||||
r = &d->io_regions[region_num];
|
|
||||||
|
|
||||||
/* enable memory mappings */
|
|
||||||
cmd = pci_config_readw(d, PCI_COMMAND);
|
|
||||||
if ( region_num == PCI_ROM_SLOT )
|
|
||||||
cmd |= 2;
|
|
||||||
else if (r->type & PCI_ADDRESS_SPACE_IO)
|
|
||||||
cmd |= 1;
|
|
||||||
else
|
|
||||||
cmd |= 2;
|
|
||||||
pci_config_writew(d, PCI_COMMAND, cmd);
|
|
||||||
}
|
|
||||||
|
|
||||||
static void pci_bios_init_device(PCIDevice *d)
|
|
||||||
{
|
|
||||||
int class;
|
|
||||||
PCIIORegion *r;
|
|
||||||
uint32_t *paddr;
|
|
||||||
int i, pin, pic_irq, vendor_id, device_id;
|
|
||||||
|
|
||||||
class = pci_config_readw(d, PCI_CLASS_DEVICE);
|
|
||||||
vendor_id = pci_config_readw(d, PCI_VENDOR_ID);
|
|
||||||
device_id = pci_config_readw(d, PCI_DEVICE_ID);
|
|
||||||
switch(class) {
|
|
||||||
case 0x0101:
|
|
||||||
if (vendor_id == 0x8086 && device_id == 0x7010) {
|
|
||||||
/* PIIX3 IDE */
|
|
||||||
pci_config_writew(d, 0x40, 0x8000); // enable IDE0
|
|
||||||
pci_config_writew(d, 0x42, 0x8000); // enable IDE1
|
|
||||||
goto default_map;
|
|
||||||
} else {
|
|
||||||
/* IDE: we map it as in ISA mode */
|
|
||||||
pci_set_io_region_addr(d, 0, 0x1f0);
|
|
||||||
pci_set_io_region_addr(d, 1, 0x3f4);
|
|
||||||
pci_set_io_region_addr(d, 2, 0x170);
|
|
||||||
pci_set_io_region_addr(d, 3, 0x374);
|
|
||||||
}
|
|
||||||
break;
|
|
||||||
case 0x0604:
|
|
||||||
/* PCI to PCI bridge. Assign bus ID and recurse to configure
|
|
||||||
devices on the secondary bus. */
|
|
||||||
i = pci_bios_next_bus++;
|
|
||||||
pci_config_writeb(d, 0x18, pci_bus_num(d->bus));
|
|
||||||
pci_config_writeb(d, 0x19, i);
|
|
||||||
pci_for_each_device(i, pci_bios_init_device);
|
|
||||||
break;
|
|
||||||
case 0x0300:
|
|
||||||
if (vendor_id != 0x1234)
|
|
||||||
goto default_map;
|
|
||||||
/* VGA: map frame buffer to default Bochs VBE address */
|
|
||||||
pci_set_io_region_addr(d, 0, 0xE0000000);
|
|
||||||
break;
|
|
||||||
case 0x0800:
|
|
||||||
/* PIC */
|
|
||||||
vendor_id = pci_config_readw(d, PCI_VENDOR_ID);
|
|
||||||
device_id = pci_config_readw(d, PCI_DEVICE_ID);
|
|
||||||
if (vendor_id == 0x1014) {
|
|
||||||
/* IBM */
|
|
||||||
if (device_id == 0x0046 || device_id == 0xFFFF) {
|
|
||||||
/* MPIC & MPIC2 */
|
|
||||||
pci_set_io_region_addr(d, 0, 0x80800000 + 0x00040000);
|
|
||||||
}
|
|
||||||
}
|
|
||||||
break;
|
|
||||||
case 0xff00:
|
|
||||||
if (vendor_id == 0x0106b &&
|
|
||||||
(device_id == 0x0017 || device_id == 0x0022)) {
|
|
||||||
/* macio bridge */
|
|
||||||
pci_set_io_region_addr(d, 0, 0x80800000);
|
|
||||||
}
|
|
||||||
break;
|
|
||||||
default:
|
|
||||||
default_map:
|
|
||||||
/* default memory mappings */
|
|
||||||
for(i = 0; i < PCI_NUM_REGIONS; i++) {
|
|
||||||
r = &d->io_regions[i];
|
|
||||||
if (r->size) {
|
|
||||||
if (r->type & PCI_ADDRESS_SPACE_IO)
|
|
||||||
paddr = &pci_bios_io_addr;
|
|
||||||
else
|
|
||||||
paddr = &pci_bios_mem_addr;
|
|
||||||
*paddr = (*paddr + r->size - 1) & ~(r->size - 1);
|
|
||||||
pci_set_io_region_addr(d, i, *paddr);
|
|
||||||
*paddr += r->size;
|
|
||||||
}
|
|
||||||
}
|
|
||||||
break;
|
|
||||||
}
|
|
||||||
|
|
||||||
/* map the interrupt */
|
|
||||||
pin = pci_config_readb(d, PCI_INTERRUPT_PIN);
|
|
||||||
if (pin != 0) {
|
|
||||||
pin = pci_slot_get_pirq(d, pin - 1);
|
|
||||||
pic_irq = pci_irqs[pin];
|
|
||||||
pci_config_writeb(d, PCI_INTERRUPT_LINE, pic_irq);
|
|
||||||
}
|
|
||||||
}
|
|
||||||
|
|
||||||
/*
|
|
||||||
* This function initializes the PCI devices as a normal PCI BIOS
|
|
||||||
* would do. It is provided just in case the BIOS has no support for
|
|
||||||
* PCI.
|
|
||||||
*/
|
|
||||||
void pci_bios_init(void)
|
|
||||||
{
|
|
||||||
int i, irq;
|
|
||||||
uint8_t elcr[2];
|
|
||||||
|
|
||||||
pci_bios_io_addr = 0xc000;
|
|
||||||
pci_bios_mem_addr = 0xf0000000;
|
|
||||||
|
|
||||||
/* activate IRQ mappings */
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elcr[0] = 0x00;
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elcr[1] = 0x00;
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for(i = 0; i < 4; i++) {
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irq = pci_irqs[i];
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/* set to trigger level */
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elcr[irq >> 3] |= (1 << (irq & 7));
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/* activate irq remapping in PIIX */
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pci_config_writeb(piix3_dev, 0x60 + i, irq);
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}
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isa_outb(elcr[0], 0x4d0);
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isa_outb(elcr[1], 0x4d1);
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pci_bios_next_bus = 1;
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pci_for_each_device(0, pci_bios_init_device);
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}
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