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target/loongarch: Implement vseq vsle vslt
This patch includes:
- VSEQ[I].{B/H/W/D};
- VSLE[I].{B/H/W/D}[U];
- VSLT[I].{B/H/W/D/}[U].
Reviewed-by: Richard Henderson <richard.henderson@linaro.org>
Signed-off-by: Song Gao <gaosong@loongson.cn>
Message-Id: <20230504122810.4094787-36-gaosong@loongson.cn>
This commit is contained in:
Song Gao
parent
399665d2af
commit
f435e1e5af
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@ -1404,3 +1404,46 @@ INSN_LSX(vffint_d_lu, vv)
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INSN_LSX(vffintl_d_w, vv)
|
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INSN_LSX(vffinth_d_w, vv)
|
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INSN_LSX(vffint_s_l, vvv)
|
||||
|
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INSN_LSX(vseq_b, vvv)
|
||||
INSN_LSX(vseq_h, vvv)
|
||||
INSN_LSX(vseq_w, vvv)
|
||||
INSN_LSX(vseq_d, vvv)
|
||||
INSN_LSX(vseqi_b, vv_i)
|
||||
INSN_LSX(vseqi_h, vv_i)
|
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INSN_LSX(vseqi_w, vv_i)
|
||||
INSN_LSX(vseqi_d, vv_i)
|
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|
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INSN_LSX(vsle_b, vvv)
|
||||
INSN_LSX(vsle_h, vvv)
|
||||
INSN_LSX(vsle_w, vvv)
|
||||
INSN_LSX(vsle_d, vvv)
|
||||
INSN_LSX(vslei_b, vv_i)
|
||||
INSN_LSX(vslei_h, vv_i)
|
||||
INSN_LSX(vslei_w, vv_i)
|
||||
INSN_LSX(vslei_d, vv_i)
|
||||
INSN_LSX(vsle_bu, vvv)
|
||||
INSN_LSX(vsle_hu, vvv)
|
||||
INSN_LSX(vsle_wu, vvv)
|
||||
INSN_LSX(vsle_du, vvv)
|
||||
INSN_LSX(vslei_bu, vv_i)
|
||||
INSN_LSX(vslei_hu, vv_i)
|
||||
INSN_LSX(vslei_wu, vv_i)
|
||||
INSN_LSX(vslei_du, vv_i)
|
||||
|
||||
INSN_LSX(vslt_b, vvv)
|
||||
INSN_LSX(vslt_h, vvv)
|
||||
INSN_LSX(vslt_w, vvv)
|
||||
INSN_LSX(vslt_d, vvv)
|
||||
INSN_LSX(vslti_b, vv_i)
|
||||
INSN_LSX(vslti_h, vv_i)
|
||||
INSN_LSX(vslti_w, vv_i)
|
||||
INSN_LSX(vslti_d, vv_i)
|
||||
INSN_LSX(vslt_bu, vvv)
|
||||
INSN_LSX(vslt_hu, vvv)
|
||||
INSN_LSX(vslt_wu, vvv)
|
||||
INSN_LSX(vslt_du, vvv)
|
||||
INSN_LSX(vslti_bu, vv_i)
|
||||
INSN_LSX(vslti_hu, vv_i)
|
||||
INSN_LSX(vslti_wu, vv_i)
|
||||
INSN_LSX(vslti_du, vv_i)
|
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|
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@ -614,3 +614,26 @@ DEF_HELPER_3(vffint_d_lu, void, env, i32, i32)
|
|||
DEF_HELPER_3(vffintl_d_w, void, env, i32, i32)
|
||||
DEF_HELPER_3(vffinth_d_w, void, env, i32, i32)
|
||||
DEF_HELPER_4(vffint_s_l, void, env, i32, i32, i32)
|
||||
|
||||
DEF_HELPER_FLAGS_4(vseqi_b, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vseqi_h, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vseqi_w, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vseqi_d, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
|
||||
DEF_HELPER_FLAGS_4(vslei_b, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslei_h, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslei_w, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslei_d, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslei_bu, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslei_hu, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslei_wu, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslei_du, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
|
||||
DEF_HELPER_FLAGS_4(vslti_b, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslti_h, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslti_w, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslti_d, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslti_bu, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslti_hu, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslti_wu, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
DEF_HELPER_FLAGS_4(vslti_du, TCG_CALL_NO_RWG, void, ptr, ptr, i64, i32)
|
||||
|
|
|
|||
|
|
@ -3532,3 +3532,188 @@ TRANS(vffint_d_lu, gen_vv, gen_helper_vffint_d_lu)
|
|||
TRANS(vffintl_d_w, gen_vv, gen_helper_vffintl_d_w)
|
||||
TRANS(vffinth_d_w, gen_vv, gen_helper_vffinth_d_w)
|
||||
TRANS(vffint_s_l, gen_vvv, gen_helper_vffint_s_l)
|
||||
|
||||
static bool do_cmp(DisasContext *ctx, arg_vvv *a, MemOp mop, TCGCond cond)
|
||||
{
|
||||
uint32_t vd_ofs, vj_ofs, vk_ofs;
|
||||
|
||||
CHECK_SXE;
|
||||
|
||||
vd_ofs = vec_full_offset(a->vd);
|
||||
vj_ofs = vec_full_offset(a->vj);
|
||||
vk_ofs = vec_full_offset(a->vk);
|
||||
|
||||
tcg_gen_gvec_cmp(cond, mop, vd_ofs, vj_ofs, vk_ofs, 16, ctx->vl/8);
|
||||
return true;
|
||||
}
|
||||
|
||||
static void do_cmpi_vec(TCGCond cond,
|
||||
unsigned vece, TCGv_vec t, TCGv_vec a, int64_t imm)
|
||||
{
|
||||
tcg_gen_cmp_vec(cond, vece, t, a, tcg_constant_vec_matching(t, vece, imm));
|
||||
}
|
||||
|
||||
static void gen_vseqi_s_vec(unsigned vece, TCGv_vec t, TCGv_vec a, int64_t imm)
|
||||
{
|
||||
do_cmpi_vec(TCG_COND_EQ, vece, t, a, imm);
|
||||
}
|
||||
|
||||
static void gen_vslei_s_vec(unsigned vece, TCGv_vec t, TCGv_vec a, int64_t imm)
|
||||
{
|
||||
do_cmpi_vec(TCG_COND_LE, vece, t, a, imm);
|
||||
}
|
||||
|
||||
static void gen_vslti_s_vec(unsigned vece, TCGv_vec t, TCGv_vec a, int64_t imm)
|
||||
{
|
||||
do_cmpi_vec(TCG_COND_LT, vece, t, a, imm);
|
||||
}
|
||||
|
||||
static void gen_vslei_u_vec(unsigned vece, TCGv_vec t, TCGv_vec a, int64_t imm)
|
||||
{
|
||||
do_cmpi_vec(TCG_COND_LEU, vece, t, a, imm);
|
||||
}
|
||||
|
||||
static void gen_vslti_u_vec(unsigned vece, TCGv_vec t, TCGv_vec a, int64_t imm)
|
||||
{
|
||||
do_cmpi_vec(TCG_COND_LTU, vece, t, a, imm);
|
||||
}
|
||||
|
||||
#define DO_CMPI_S(NAME) \
|
||||
static bool do_## NAME ##_s(DisasContext *ctx, arg_vv_i *a, MemOp mop) \
|
||||
{ \
|
||||
uint32_t vd_ofs, vj_ofs; \
|
||||
\
|
||||
CHECK_SXE; \
|
||||
\
|
||||
static const TCGOpcode vecop_list[] = { \
|
||||
INDEX_op_cmp_vec, 0 \
|
||||
}; \
|
||||
static const GVecGen2i op[4] = { \
|
||||
{ \
|
||||
.fniv = gen_## NAME ##_s_vec, \
|
||||
.fnoi = gen_helper_## NAME ##_b, \
|
||||
.opt_opc = vecop_list, \
|
||||
.vece = MO_8 \
|
||||
}, \
|
||||
{ \
|
||||
.fniv = gen_## NAME ##_s_vec, \
|
||||
.fnoi = gen_helper_## NAME ##_h, \
|
||||
.opt_opc = vecop_list, \
|
||||
.vece = MO_16 \
|
||||
}, \
|
||||
{ \
|
||||
.fniv = gen_## NAME ##_s_vec, \
|
||||
.fnoi = gen_helper_## NAME ##_w, \
|
||||
.opt_opc = vecop_list, \
|
||||
.vece = MO_32 \
|
||||
}, \
|
||||
{ \
|
||||
.fniv = gen_## NAME ##_s_vec, \
|
||||
.fnoi = gen_helper_## NAME ##_d, \
|
||||
.opt_opc = vecop_list, \
|
||||
.vece = MO_64 \
|
||||
} \
|
||||
}; \
|
||||
\
|
||||
vd_ofs = vec_full_offset(a->vd); \
|
||||
vj_ofs = vec_full_offset(a->vj); \
|
||||
\
|
||||
tcg_gen_gvec_2i(vd_ofs, vj_ofs, 16, ctx->vl/8, a->imm, &op[mop]); \
|
||||
\
|
||||
return true; \
|
||||
}
|
||||
|
||||
DO_CMPI_S(vseqi)
|
||||
DO_CMPI_S(vslei)
|
||||
DO_CMPI_S(vslti)
|
||||
|
||||
#define DO_CMPI_U(NAME) \
|
||||
static bool do_## NAME ##_u(DisasContext *ctx, arg_vv_i *a, MemOp mop) \
|
||||
{ \
|
||||
uint32_t vd_ofs, vj_ofs; \
|
||||
\
|
||||
CHECK_SXE; \
|
||||
\
|
||||
static const TCGOpcode vecop_list[] = { \
|
||||
INDEX_op_cmp_vec, 0 \
|
||||
}; \
|
||||
static const GVecGen2i op[4] = { \
|
||||
{ \
|
||||
.fniv = gen_## NAME ##_u_vec, \
|
||||
.fnoi = gen_helper_## NAME ##_bu, \
|
||||
.opt_opc = vecop_list, \
|
||||
.vece = MO_8 \
|
||||
}, \
|
||||
{ \
|
||||
.fniv = gen_## NAME ##_u_vec, \
|
||||
.fnoi = gen_helper_## NAME ##_hu, \
|
||||
.opt_opc = vecop_list, \
|
||||
.vece = MO_16 \
|
||||
}, \
|
||||
{ \
|
||||
.fniv = gen_## NAME ##_u_vec, \
|
||||
.fnoi = gen_helper_## NAME ##_wu, \
|
||||
.opt_opc = vecop_list, \
|
||||
.vece = MO_32 \
|
||||
}, \
|
||||
{ \
|
||||
.fniv = gen_## NAME ##_u_vec, \
|
||||
.fnoi = gen_helper_## NAME ##_du, \
|
||||
.opt_opc = vecop_list, \
|
||||
.vece = MO_64 \
|
||||
} \
|
||||
}; \
|
||||
\
|
||||
vd_ofs = vec_full_offset(a->vd); \
|
||||
vj_ofs = vec_full_offset(a->vj); \
|
||||
\
|
||||
tcg_gen_gvec_2i(vd_ofs, vj_ofs, 16, ctx->vl/8, a->imm, &op[mop]); \
|
||||
\
|
||||
return true; \
|
||||
}
|
||||
|
||||
DO_CMPI_U(vslei)
|
||||
DO_CMPI_U(vslti)
|
||||
|
||||
TRANS(vseq_b, do_cmp, MO_8, TCG_COND_EQ)
|
||||
TRANS(vseq_h, do_cmp, MO_16, TCG_COND_EQ)
|
||||
TRANS(vseq_w, do_cmp, MO_32, TCG_COND_EQ)
|
||||
TRANS(vseq_d, do_cmp, MO_64, TCG_COND_EQ)
|
||||
TRANS(vseqi_b, do_vseqi_s, MO_8)
|
||||
TRANS(vseqi_h, do_vseqi_s, MO_16)
|
||||
TRANS(vseqi_w, do_vseqi_s, MO_32)
|
||||
TRANS(vseqi_d, do_vseqi_s, MO_64)
|
||||
|
||||
TRANS(vsle_b, do_cmp, MO_8, TCG_COND_LE)
|
||||
TRANS(vsle_h, do_cmp, MO_16, TCG_COND_LE)
|
||||
TRANS(vsle_w, do_cmp, MO_32, TCG_COND_LE)
|
||||
TRANS(vsle_d, do_cmp, MO_64, TCG_COND_LE)
|
||||
TRANS(vslei_b, do_vslei_s, MO_8)
|
||||
TRANS(vslei_h, do_vslei_s, MO_16)
|
||||
TRANS(vslei_w, do_vslei_s, MO_32)
|
||||
TRANS(vslei_d, do_vslei_s, MO_64)
|
||||
TRANS(vsle_bu, do_cmp, MO_8, TCG_COND_LEU)
|
||||
TRANS(vsle_hu, do_cmp, MO_16, TCG_COND_LEU)
|
||||
TRANS(vsle_wu, do_cmp, MO_32, TCG_COND_LEU)
|
||||
TRANS(vsle_du, do_cmp, MO_64, TCG_COND_LEU)
|
||||
TRANS(vslei_bu, do_vslei_u, MO_8)
|
||||
TRANS(vslei_hu, do_vslei_u, MO_16)
|
||||
TRANS(vslei_wu, do_vslei_u, MO_32)
|
||||
TRANS(vslei_du, do_vslei_u, MO_64)
|
||||
|
||||
TRANS(vslt_b, do_cmp, MO_8, TCG_COND_LT)
|
||||
TRANS(vslt_h, do_cmp, MO_16, TCG_COND_LT)
|
||||
TRANS(vslt_w, do_cmp, MO_32, TCG_COND_LT)
|
||||
TRANS(vslt_d, do_cmp, MO_64, TCG_COND_LT)
|
||||
TRANS(vslti_b, do_vslti_s, MO_8)
|
||||
TRANS(vslti_h, do_vslti_s, MO_16)
|
||||
TRANS(vslti_w, do_vslti_s, MO_32)
|
||||
TRANS(vslti_d, do_vslti_s, MO_64)
|
||||
TRANS(vslt_bu, do_cmp, MO_8, TCG_COND_LTU)
|
||||
TRANS(vslt_hu, do_cmp, MO_16, TCG_COND_LTU)
|
||||
TRANS(vslt_wu, do_cmp, MO_32, TCG_COND_LTU)
|
||||
TRANS(vslt_du, do_cmp, MO_64, TCG_COND_LTU)
|
||||
TRANS(vslti_bu, do_vslti_u, MO_8)
|
||||
TRANS(vslti_hu, do_vslti_u, MO_16)
|
||||
TRANS(vslti_wu, do_vslti_u, MO_32)
|
||||
TRANS(vslti_du, do_vslti_u, MO_64)
|
||||
|
|
|
|||
|
|
@ -1102,3 +1102,46 @@ vffint_d_lu 0111 00101001 11100 00011 ..... ..... @vv
|
|||
vffintl_d_w 0111 00101001 11100 00100 ..... ..... @vv
|
||||
vffinth_d_w 0111 00101001 11100 00101 ..... ..... @vv
|
||||
vffint_s_l 0111 00010100 10000 ..... ..... ..... @vvv
|
||||
|
||||
vseq_b 0111 00000000 00000 ..... ..... ..... @vvv
|
||||
vseq_h 0111 00000000 00001 ..... ..... ..... @vvv
|
||||
vseq_w 0111 00000000 00010 ..... ..... ..... @vvv
|
||||
vseq_d 0111 00000000 00011 ..... ..... ..... @vvv
|
||||
vseqi_b 0111 00101000 00000 ..... ..... ..... @vv_i5
|
||||
vseqi_h 0111 00101000 00001 ..... ..... ..... @vv_i5
|
||||
vseqi_w 0111 00101000 00010 ..... ..... ..... @vv_i5
|
||||
vseqi_d 0111 00101000 00011 ..... ..... ..... @vv_i5
|
||||
|
||||
vsle_b 0111 00000000 00100 ..... ..... ..... @vvv
|
||||
vsle_h 0111 00000000 00101 ..... ..... ..... @vvv
|
||||
vsle_w 0111 00000000 00110 ..... ..... ..... @vvv
|
||||
vsle_d 0111 00000000 00111 ..... ..... ..... @vvv
|
||||
vslei_b 0111 00101000 00100 ..... ..... ..... @vv_i5
|
||||
vslei_h 0111 00101000 00101 ..... ..... ..... @vv_i5
|
||||
vslei_w 0111 00101000 00110 ..... ..... ..... @vv_i5
|
||||
vslei_d 0111 00101000 00111 ..... ..... ..... @vv_i5
|
||||
vsle_bu 0111 00000000 01000 ..... ..... ..... @vvv
|
||||
vsle_hu 0111 00000000 01001 ..... ..... ..... @vvv
|
||||
vsle_wu 0111 00000000 01010 ..... ..... ..... @vvv
|
||||
vsle_du 0111 00000000 01011 ..... ..... ..... @vvv
|
||||
vslei_bu 0111 00101000 01000 ..... ..... ..... @vv_ui5
|
||||
vslei_hu 0111 00101000 01001 ..... ..... ..... @vv_ui5
|
||||
vslei_wu 0111 00101000 01010 ..... ..... ..... @vv_ui5
|
||||
vslei_du 0111 00101000 01011 ..... ..... ..... @vv_ui5
|
||||
|
||||
vslt_b 0111 00000000 01100 ..... ..... ..... @vvv
|
||||
vslt_h 0111 00000000 01101 ..... ..... ..... @vvv
|
||||
vslt_w 0111 00000000 01110 ..... ..... ..... @vvv
|
||||
vslt_d 0111 00000000 01111 ..... ..... ..... @vvv
|
||||
vslti_b 0111 00101000 01100 ..... ..... ..... @vv_i5
|
||||
vslti_h 0111 00101000 01101 ..... ..... ..... @vv_i5
|
||||
vslti_w 0111 00101000 01110 ..... ..... ..... @vv_i5
|
||||
vslti_d 0111 00101000 01111 ..... ..... ..... @vv_i5
|
||||
vslt_bu 0111 00000000 10000 ..... ..... ..... @vvv
|
||||
vslt_hu 0111 00000000 10001 ..... ..... ..... @vvv
|
||||
vslt_wu 0111 00000000 10010 ..... ..... ..... @vvv
|
||||
vslt_du 0111 00000000 10011 ..... ..... ..... @vvv
|
||||
vslti_bu 0111 00101000 10000 ..... ..... ..... @vv_ui5
|
||||
vslti_hu 0111 00101000 10001 ..... ..... ..... @vv_ui5
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vslti_wu 0111 00101000 10010 ..... ..... ..... @vv_ui5
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vslti_du 0111 00101000 10011 ..... ..... ..... @vv_ui5
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@ -2622,3 +2622,41 @@ void HELPER(vffint_s_l)(CPULoongArchState *env,
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}
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*Vd = temp;
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}
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#define VSEQ(a, b) (a == b ? -1 : 0)
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#define VSLE(a, b) (a <= b ? -1 : 0)
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#define VSLT(a, b) (a < b ? -1 : 0)
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#define VCMPI(NAME, BIT, E, DO_OP) \
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void HELPER(NAME)(void *vd, void *vj, uint64_t imm, uint32_t v) \
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{ \
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int i; \
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VReg *Vd = (VReg *)vd; \
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VReg *Vj = (VReg *)vj; \
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typedef __typeof(Vd->E(0)) TD; \
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||||
\
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for (i = 0; i < LSX_LEN/BIT; i++) { \
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Vd->E(i) = DO_OP(Vj->E(i), (TD)imm); \
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} \
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||||
}
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VCMPI(vseqi_b, 8, B, VSEQ)
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VCMPI(vseqi_h, 16, H, VSEQ)
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||||
VCMPI(vseqi_w, 32, W, VSEQ)
|
||||
VCMPI(vseqi_d, 64, D, VSEQ)
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||||
VCMPI(vslei_b, 8, B, VSLE)
|
||||
VCMPI(vslei_h, 16, H, VSLE)
|
||||
VCMPI(vslei_w, 32, W, VSLE)
|
||||
VCMPI(vslei_d, 64, D, VSLE)
|
||||
VCMPI(vslei_bu, 8, UB, VSLE)
|
||||
VCMPI(vslei_hu, 16, UH, VSLE)
|
||||
VCMPI(vslei_wu, 32, UW, VSLE)
|
||||
VCMPI(vslei_du, 64, UD, VSLE)
|
||||
VCMPI(vslti_b, 8, B, VSLT)
|
||||
VCMPI(vslti_h, 16, H, VSLT)
|
||||
VCMPI(vslti_w, 32, W, VSLT)
|
||||
VCMPI(vslti_d, 64, D, VSLT)
|
||||
VCMPI(vslti_bu, 8, UB, VSLT)
|
||||
VCMPI(vslti_hu, 16, UH, VSLT)
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VCMPI(vslti_wu, 32, UW, VSLT)
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VCMPI(vslti_du, 64, UD, VSLT)
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