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target/i386: move TLB refill function out of helper.c
This function calls tlb_set_page_with_attrs, which is not available when TCG is disabled. Move it to excp_helper.c. Signed-off-by: Paolo Bonzini <pbonzini@redhat.com>
This commit is contained in:
Paolo Bonzini
parent
1d8ad165b6
commit
6578eb25a0
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@ -136,3 +136,346 @@ void raise_exception_ra(CPUX86State *env, int exception_index, uintptr_t retaddr
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||||||
{
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{
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||||||
raise_interrupt2(env, exception_index, 0, 0, 0, retaddr);
|
raise_interrupt2(env, exception_index, 0, 0, 0, retaddr);
|
||||||
}
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}
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||||||
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#if defined(CONFIG_USER_ONLY)
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||||||
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int x86_cpu_handle_mmu_fault(CPUState *cs, vaddr addr,
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int is_write, int mmu_idx)
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||||||
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{
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||||||
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X86CPU *cpu = X86_CPU(cs);
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CPUX86State *env = &cpu->env;
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/* user mode only emulation */
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is_write &= 1;
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env->cr[2] = addr;
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env->error_code = (is_write << PG_ERROR_W_BIT);
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env->error_code |= PG_ERROR_U_MASK;
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||||||
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cs->exception_index = EXCP0E_PAGE;
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env->exception_is_int = 0;
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||||||
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env->exception_next_eip = -1;
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return 1;
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}
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#else
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/* return value:
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* -1 = cannot handle fault
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* 0 = nothing more to do
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* 1 = generate PF fault
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*/
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||||||
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int x86_cpu_handle_mmu_fault(CPUState *cs, vaddr addr,
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||||||
|
int is_write1, int mmu_idx)
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||||||
|
{
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||||||
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X86CPU *cpu = X86_CPU(cs);
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||||||
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CPUX86State *env = &cpu->env;
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||||||
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uint64_t ptep, pte;
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||||||
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int32_t a20_mask;
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target_ulong pde_addr, pte_addr;
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int error_code = 0;
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int is_dirty, prot, page_size, is_write, is_user;
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hwaddr paddr;
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||||||
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uint64_t rsvd_mask = PG_HI_RSVD_MASK;
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||||||
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uint32_t page_offset;
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target_ulong vaddr;
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is_user = mmu_idx == MMU_USER_IDX;
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#if defined(DEBUG_MMU)
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|
printf("MMU fault: addr=%" VADDR_PRIx " w=%d u=%d eip=" TARGET_FMT_lx "\n",
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addr, is_write1, is_user, env->eip);
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||||||
|
#endif
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is_write = is_write1 & 1;
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||||||
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||||||
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a20_mask = x86_get_a20_mask(env);
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||||||
|
if (!(env->cr[0] & CR0_PG_MASK)) {
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pte = addr;
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||||||
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#ifdef TARGET_X86_64
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||||||
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if (!(env->hflags & HF_LMA_MASK)) {
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/* Without long mode we can only address 32bits in real mode */
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||||||
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pte = (uint32_t)pte;
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}
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||||||
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#endif
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||||||
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prot = PAGE_READ | PAGE_WRITE | PAGE_EXEC;
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||||||
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page_size = 4096;
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||||||
|
goto do_mapping;
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|
}
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||||||
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||||||
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if (!(env->efer & MSR_EFER_NXE)) {
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||||||
|
rsvd_mask |= PG_NX_MASK;
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|
}
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||||||
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|
||||||
|
if (env->cr[4] & CR4_PAE_MASK) {
|
||||||
|
uint64_t pde, pdpe;
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||||||
|
target_ulong pdpe_addr;
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||||||
|
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||||||
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#ifdef TARGET_X86_64
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||||||
|
if (env->hflags & HF_LMA_MASK) {
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||||||
|
bool la57 = env->cr[4] & CR4_LA57_MASK;
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||||||
|
uint64_t pml5e_addr, pml5e;
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||||||
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uint64_t pml4e_addr, pml4e;
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||||||
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int32_t sext;
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||||||
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||||||
|
/* test virtual address sign extension */
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||||||
|
sext = la57 ? (int64_t)addr >> 56 : (int64_t)addr >> 47;
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||||||
|
if (sext != 0 && sext != -1) {
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||||||
|
env->error_code = 0;
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||||||
|
cs->exception_index = EXCP0D_GPF;
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||||||
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return 1;
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}
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||||||
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||||||
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if (la57) {
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||||||
|
pml5e_addr = ((env->cr[3] & ~0xfff) +
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||||||
|
(((addr >> 48) & 0x1ff) << 3)) & a20_mask;
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||||||
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pml5e = x86_ldq_phys(cs, pml5e_addr);
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||||||
|
if (!(pml5e & PG_PRESENT_MASK)) {
|
||||||
|
goto do_fault;
|
||||||
|
}
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||||||
|
if (pml5e & (rsvd_mask | PG_PSE_MASK)) {
|
||||||
|
goto do_fault_rsvd;
|
||||||
|
}
|
||||||
|
if (!(pml5e & PG_ACCESSED_MASK)) {
|
||||||
|
pml5e |= PG_ACCESSED_MASK;
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||||||
|
x86_stl_phys_notdirty(cs, pml5e_addr, pml5e);
|
||||||
|
}
|
||||||
|
ptep = pml5e ^ PG_NX_MASK;
|
||||||
|
} else {
|
||||||
|
pml5e = env->cr[3];
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||||||
|
ptep = PG_NX_MASK | PG_USER_MASK | PG_RW_MASK;
|
||||||
|
}
|
||||||
|
|
||||||
|
pml4e_addr = ((pml5e & PG_ADDRESS_MASK) +
|
||||||
|
(((addr >> 39) & 0x1ff) << 3)) & a20_mask;
|
||||||
|
pml4e = x86_ldq_phys(cs, pml4e_addr);
|
||||||
|
if (!(pml4e & PG_PRESENT_MASK)) {
|
||||||
|
goto do_fault;
|
||||||
|
}
|
||||||
|
if (pml4e & (rsvd_mask | PG_PSE_MASK)) {
|
||||||
|
goto do_fault_rsvd;
|
||||||
|
}
|
||||||
|
if (!(pml4e & PG_ACCESSED_MASK)) {
|
||||||
|
pml4e |= PG_ACCESSED_MASK;
|
||||||
|
x86_stl_phys_notdirty(cs, pml4e_addr, pml4e);
|
||||||
|
}
|
||||||
|
ptep &= pml4e ^ PG_NX_MASK;
|
||||||
|
pdpe_addr = ((pml4e & PG_ADDRESS_MASK) + (((addr >> 30) & 0x1ff) << 3)) &
|
||||||
|
a20_mask;
|
||||||
|
pdpe = x86_ldq_phys(cs, pdpe_addr);
|
||||||
|
if (!(pdpe & PG_PRESENT_MASK)) {
|
||||||
|
goto do_fault;
|
||||||
|
}
|
||||||
|
if (pdpe & rsvd_mask) {
|
||||||
|
goto do_fault_rsvd;
|
||||||
|
}
|
||||||
|
ptep &= pdpe ^ PG_NX_MASK;
|
||||||
|
if (!(pdpe & PG_ACCESSED_MASK)) {
|
||||||
|
pdpe |= PG_ACCESSED_MASK;
|
||||||
|
x86_stl_phys_notdirty(cs, pdpe_addr, pdpe);
|
||||||
|
}
|
||||||
|
if (pdpe & PG_PSE_MASK) {
|
||||||
|
/* 1 GB page */
|
||||||
|
page_size = 1024 * 1024 * 1024;
|
||||||
|
pte_addr = pdpe_addr;
|
||||||
|
pte = pdpe;
|
||||||
|
goto do_check_protect;
|
||||||
|
}
|
||||||
|
} else
|
||||||
|
#endif
|
||||||
|
{
|
||||||
|
/* XXX: load them when cr3 is loaded ? */
|
||||||
|
pdpe_addr = ((env->cr[3] & ~0x1f) + ((addr >> 27) & 0x18)) &
|
||||||
|
a20_mask;
|
||||||
|
pdpe = x86_ldq_phys(cs, pdpe_addr);
|
||||||
|
if (!(pdpe & PG_PRESENT_MASK)) {
|
||||||
|
goto do_fault;
|
||||||
|
}
|
||||||
|
rsvd_mask |= PG_HI_USER_MASK;
|
||||||
|
if (pdpe & (rsvd_mask | PG_NX_MASK)) {
|
||||||
|
goto do_fault_rsvd;
|
||||||
|
}
|
||||||
|
ptep = PG_NX_MASK | PG_USER_MASK | PG_RW_MASK;
|
||||||
|
}
|
||||||
|
|
||||||
|
pde_addr = ((pdpe & PG_ADDRESS_MASK) + (((addr >> 21) & 0x1ff) << 3)) &
|
||||||
|
a20_mask;
|
||||||
|
pde = x86_ldq_phys(cs, pde_addr);
|
||||||
|
if (!(pde & PG_PRESENT_MASK)) {
|
||||||
|
goto do_fault;
|
||||||
|
}
|
||||||
|
if (pde & rsvd_mask) {
|
||||||
|
goto do_fault_rsvd;
|
||||||
|
}
|
||||||
|
ptep &= pde ^ PG_NX_MASK;
|
||||||
|
if (pde & PG_PSE_MASK) {
|
||||||
|
/* 2 MB page */
|
||||||
|
page_size = 2048 * 1024;
|
||||||
|
pte_addr = pde_addr;
|
||||||
|
pte = pde;
|
||||||
|
goto do_check_protect;
|
||||||
|
}
|
||||||
|
/* 4 KB page */
|
||||||
|
if (!(pde & PG_ACCESSED_MASK)) {
|
||||||
|
pde |= PG_ACCESSED_MASK;
|
||||||
|
x86_stl_phys_notdirty(cs, pde_addr, pde);
|
||||||
|
}
|
||||||
|
pte_addr = ((pde & PG_ADDRESS_MASK) + (((addr >> 12) & 0x1ff) << 3)) &
|
||||||
|
a20_mask;
|
||||||
|
pte = x86_ldq_phys(cs, pte_addr);
|
||||||
|
if (!(pte & PG_PRESENT_MASK)) {
|
||||||
|
goto do_fault;
|
||||||
|
}
|
||||||
|
if (pte & rsvd_mask) {
|
||||||
|
goto do_fault_rsvd;
|
||||||
|
}
|
||||||
|
/* combine pde and pte nx, user and rw protections */
|
||||||
|
ptep &= pte ^ PG_NX_MASK;
|
||||||
|
page_size = 4096;
|
||||||
|
} else {
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||||||
|
uint32_t pde;
|
||||||
|
|
||||||
|
/* page directory entry */
|
||||||
|
pde_addr = ((env->cr[3] & ~0xfff) + ((addr >> 20) & 0xffc)) &
|
||||||
|
a20_mask;
|
||||||
|
pde = x86_ldl_phys(cs, pde_addr);
|
||||||
|
if (!(pde & PG_PRESENT_MASK)) {
|
||||||
|
goto do_fault;
|
||||||
|
}
|
||||||
|
ptep = pde | PG_NX_MASK;
|
||||||
|
|
||||||
|
/* if PSE bit is set, then we use a 4MB page */
|
||||||
|
if ((pde & PG_PSE_MASK) && (env->cr[4] & CR4_PSE_MASK)) {
|
||||||
|
page_size = 4096 * 1024;
|
||||||
|
pte_addr = pde_addr;
|
||||||
|
|
||||||
|
/* Bits 20-13 provide bits 39-32 of the address, bit 21 is reserved.
|
||||||
|
* Leave bits 20-13 in place for setting accessed/dirty bits below.
|
||||||
|
*/
|
||||||
|
pte = pde | ((pde & 0x1fe000LL) << (32 - 13));
|
||||||
|
rsvd_mask = 0x200000;
|
||||||
|
goto do_check_protect_pse36;
|
||||||
|
}
|
||||||
|
|
||||||
|
if (!(pde & PG_ACCESSED_MASK)) {
|
||||||
|
pde |= PG_ACCESSED_MASK;
|
||||||
|
x86_stl_phys_notdirty(cs, pde_addr, pde);
|
||||||
|
}
|
||||||
|
|
||||||
|
/* page directory entry */
|
||||||
|
pte_addr = ((pde & ~0xfff) + ((addr >> 10) & 0xffc)) &
|
||||||
|
a20_mask;
|
||||||
|
pte = x86_ldl_phys(cs, pte_addr);
|
||||||
|
if (!(pte & PG_PRESENT_MASK)) {
|
||||||
|
goto do_fault;
|
||||||
|
}
|
||||||
|
/* combine pde and pte user and rw protections */
|
||||||
|
ptep &= pte | PG_NX_MASK;
|
||||||
|
page_size = 4096;
|
||||||
|
rsvd_mask = 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
do_check_protect:
|
||||||
|
rsvd_mask |= (page_size - 1) & PG_ADDRESS_MASK & ~PG_PSE_PAT_MASK;
|
||||||
|
do_check_protect_pse36:
|
||||||
|
if (pte & rsvd_mask) {
|
||||||
|
goto do_fault_rsvd;
|
||||||
|
}
|
||||||
|
ptep ^= PG_NX_MASK;
|
||||||
|
|
||||||
|
/* can the page can be put in the TLB? prot will tell us */
|
||||||
|
if (is_user && !(ptep & PG_USER_MASK)) {
|
||||||
|
goto do_fault_protect;
|
||||||
|
}
|
||||||
|
|
||||||
|
prot = 0;
|
||||||
|
if (mmu_idx != MMU_KSMAP_IDX || !(ptep & PG_USER_MASK)) {
|
||||||
|
prot |= PAGE_READ;
|
||||||
|
if ((ptep & PG_RW_MASK) || (!is_user && !(env->cr[0] & CR0_WP_MASK))) {
|
||||||
|
prot |= PAGE_WRITE;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
if (!(ptep & PG_NX_MASK) &&
|
||||||
|
(mmu_idx == MMU_USER_IDX ||
|
||||||
|
!((env->cr[4] & CR4_SMEP_MASK) && (ptep & PG_USER_MASK)))) {
|
||||||
|
prot |= PAGE_EXEC;
|
||||||
|
}
|
||||||
|
if ((env->cr[4] & CR4_PKE_MASK) && (env->hflags & HF_LMA_MASK) &&
|
||||||
|
(ptep & PG_USER_MASK) && env->pkru) {
|
||||||
|
uint32_t pk = (pte & PG_PKRU_MASK) >> PG_PKRU_BIT;
|
||||||
|
uint32_t pkru_ad = (env->pkru >> pk * 2) & 1;
|
||||||
|
uint32_t pkru_wd = (env->pkru >> pk * 2) & 2;
|
||||||
|
uint32_t pkru_prot = PAGE_READ | PAGE_WRITE | PAGE_EXEC;
|
||||||
|
|
||||||
|
if (pkru_ad) {
|
||||||
|
pkru_prot &= ~(PAGE_READ | PAGE_WRITE);
|
||||||
|
} else if (pkru_wd && (is_user || env->cr[0] & CR0_WP_MASK)) {
|
||||||
|
pkru_prot &= ~PAGE_WRITE;
|
||||||
|
}
|
||||||
|
|
||||||
|
prot &= pkru_prot;
|
||||||
|
if ((pkru_prot & (1 << is_write1)) == 0) {
|
||||||
|
assert(is_write1 != 2);
|
||||||
|
error_code |= PG_ERROR_PK_MASK;
|
||||||
|
goto do_fault_protect;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
if ((prot & (1 << is_write1)) == 0) {
|
||||||
|
goto do_fault_protect;
|
||||||
|
}
|
||||||
|
|
||||||
|
/* yes, it can! */
|
||||||
|
is_dirty = is_write && !(pte & PG_DIRTY_MASK);
|
||||||
|
if (!(pte & PG_ACCESSED_MASK) || is_dirty) {
|
||||||
|
pte |= PG_ACCESSED_MASK;
|
||||||
|
if (is_dirty) {
|
||||||
|
pte |= PG_DIRTY_MASK;
|
||||||
|
}
|
||||||
|
x86_stl_phys_notdirty(cs, pte_addr, pte);
|
||||||
|
}
|
||||||
|
|
||||||
|
if (!(pte & PG_DIRTY_MASK)) {
|
||||||
|
/* only set write access if already dirty... otherwise wait
|
||||||
|
for dirty access */
|
||||||
|
assert(!is_write);
|
||||||
|
prot &= ~PAGE_WRITE;
|
||||||
|
}
|
||||||
|
|
||||||
|
do_mapping:
|
||||||
|
pte = pte & a20_mask;
|
||||||
|
|
||||||
|
/* align to page_size */
|
||||||
|
pte &= PG_ADDRESS_MASK & ~(page_size - 1);
|
||||||
|
|
||||||
|
/* Even if 4MB pages, we map only one 4KB page in the cache to
|
||||||
|
avoid filling it too fast */
|
||||||
|
vaddr = addr & TARGET_PAGE_MASK;
|
||||||
|
page_offset = vaddr & (page_size - 1);
|
||||||
|
paddr = pte + page_offset;
|
||||||
|
|
||||||
|
assert(prot & (1 << is_write1));
|
||||||
|
tlb_set_page_with_attrs(cs, vaddr, paddr, cpu_get_mem_attrs(env),
|
||||||
|
prot, mmu_idx, page_size);
|
||||||
|
return 0;
|
||||||
|
do_fault_rsvd:
|
||||||
|
error_code |= PG_ERROR_RSVD_MASK;
|
||||||
|
do_fault_protect:
|
||||||
|
error_code |= PG_ERROR_P_MASK;
|
||||||
|
do_fault:
|
||||||
|
error_code |= (is_write << PG_ERROR_W_BIT);
|
||||||
|
if (is_user)
|
||||||
|
error_code |= PG_ERROR_U_MASK;
|
||||||
|
if (is_write1 == 2 &&
|
||||||
|
(((env->efer & MSR_EFER_NXE) &&
|
||||||
|
(env->cr[4] & CR4_PAE_MASK)) ||
|
||||||
|
(env->cr[4] & CR4_SMEP_MASK)))
|
||||||
|
error_code |= PG_ERROR_I_D_MASK;
|
||||||
|
if (env->intercept_exceptions & (1 << EXCP0E_PAGE)) {
|
||||||
|
/* cr2 is not modified in case of exceptions */
|
||||||
|
x86_stq_phys(cs,
|
||||||
|
env->vm_vmcb + offsetof(struct vmcb, control.exit_info_2),
|
||||||
|
addr);
|
||||||
|
} else {
|
||||||
|
env->cr[2] = addr;
|
||||||
|
}
|
||||||
|
env->error_code = error_code;
|
||||||
|
cs->exception_index = EXCP0E_PAGE;
|
||||||
|
return 1;
|
||||||
|
}
|
||||||
|
#endif
|
||||||
|
|
|
||||||
|
|
@ -722,349 +722,7 @@ void cpu_x86_update_cr4(CPUX86State *env, uint32_t new_cr4)
|
||||||
cpu_sync_bndcs_hflags(env);
|
cpu_sync_bndcs_hflags(env);
|
||||||
}
|
}
|
||||||
|
|
||||||
#if defined(CONFIG_USER_ONLY)
|
#if !defined(CONFIG_USER_ONLY)
|
||||||
|
|
||||||
int x86_cpu_handle_mmu_fault(CPUState *cs, vaddr addr,
|
|
||||||
int is_write, int mmu_idx)
|
|
||||||
{
|
|
||||||
X86CPU *cpu = X86_CPU(cs);
|
|
||||||
CPUX86State *env = &cpu->env;
|
|
||||||
|
|
||||||
/* user mode only emulation */
|
|
||||||
is_write &= 1;
|
|
||||||
env->cr[2] = addr;
|
|
||||||
env->error_code = (is_write << PG_ERROR_W_BIT);
|
|
||||||
env->error_code |= PG_ERROR_U_MASK;
|
|
||||||
cs->exception_index = EXCP0E_PAGE;
|
|
||||||
env->exception_is_int = 0;
|
|
||||||
env->exception_next_eip = -1;
|
|
||||||
return 1;
|
|
||||||
}
|
|
||||||
|
|
||||||
#else
|
|
||||||
|
|
||||||
/* return value:
|
|
||||||
* -1 = cannot handle fault
|
|
||||||
* 0 = nothing more to do
|
|
||||||
* 1 = generate PF fault
|
|
||||||
*/
|
|
||||||
int x86_cpu_handle_mmu_fault(CPUState *cs, vaddr addr,
|
|
||||||
int is_write1, int mmu_idx)
|
|
||||||
{
|
|
||||||
X86CPU *cpu = X86_CPU(cs);
|
|
||||||
CPUX86State *env = &cpu->env;
|
|
||||||
uint64_t ptep, pte;
|
|
||||||
int32_t a20_mask;
|
|
||||||
target_ulong pde_addr, pte_addr;
|
|
||||||
int error_code = 0;
|
|
||||||
int is_dirty, prot, page_size, is_write, is_user;
|
|
||||||
hwaddr paddr;
|
|
||||||
uint64_t rsvd_mask = PG_HI_RSVD_MASK;
|
|
||||||
uint32_t page_offset;
|
|
||||||
target_ulong vaddr;
|
|
||||||
|
|
||||||
is_user = mmu_idx == MMU_USER_IDX;
|
|
||||||
#if defined(DEBUG_MMU)
|
|
||||||
printf("MMU fault: addr=%" VADDR_PRIx " w=%d u=%d eip=" TARGET_FMT_lx "\n",
|
|
||||||
addr, is_write1, is_user, env->eip);
|
|
||||||
#endif
|
|
||||||
is_write = is_write1 & 1;
|
|
||||||
|
|
||||||
a20_mask = x86_get_a20_mask(env);
|
|
||||||
if (!(env->cr[0] & CR0_PG_MASK)) {
|
|
||||||
pte = addr;
|
|
||||||
#ifdef TARGET_X86_64
|
|
||||||
if (!(env->hflags & HF_LMA_MASK)) {
|
|
||||||
/* Without long mode we can only address 32bits in real mode */
|
|
||||||
pte = (uint32_t)pte;
|
|
||||||
}
|
|
||||||
#endif
|
|
||||||
prot = PAGE_READ | PAGE_WRITE | PAGE_EXEC;
|
|
||||||
page_size = 4096;
|
|
||||||
goto do_mapping;
|
|
||||||
}
|
|
||||||
|
|
||||||
if (!(env->efer & MSR_EFER_NXE)) {
|
|
||||||
rsvd_mask |= PG_NX_MASK;
|
|
||||||
}
|
|
||||||
|
|
||||||
if (env->cr[4] & CR4_PAE_MASK) {
|
|
||||||
uint64_t pde, pdpe;
|
|
||||||
target_ulong pdpe_addr;
|
|
||||||
|
|
||||||
#ifdef TARGET_X86_64
|
|
||||||
if (env->hflags & HF_LMA_MASK) {
|
|
||||||
bool la57 = env->cr[4] & CR4_LA57_MASK;
|
|
||||||
uint64_t pml5e_addr, pml5e;
|
|
||||||
uint64_t pml4e_addr, pml4e;
|
|
||||||
int32_t sext;
|
|
||||||
|
|
||||||
/* test virtual address sign extension */
|
|
||||||
sext = la57 ? (int64_t)addr >> 56 : (int64_t)addr >> 47;
|
|
||||||
if (sext != 0 && sext != -1) {
|
|
||||||
env->error_code = 0;
|
|
||||||
cs->exception_index = EXCP0D_GPF;
|
|
||||||
return 1;
|
|
||||||
}
|
|
||||||
|
|
||||||
if (la57) {
|
|
||||||
pml5e_addr = ((env->cr[3] & ~0xfff) +
|
|
||||||
(((addr >> 48) & 0x1ff) << 3)) & a20_mask;
|
|
||||||
pml5e = x86_ldq_phys(cs, pml5e_addr);
|
|
||||||
if (!(pml5e & PG_PRESENT_MASK)) {
|
|
||||||
goto do_fault;
|
|
||||||
}
|
|
||||||
if (pml5e & (rsvd_mask | PG_PSE_MASK)) {
|
|
||||||
goto do_fault_rsvd;
|
|
||||||
}
|
|
||||||
if (!(pml5e & PG_ACCESSED_MASK)) {
|
|
||||||
pml5e |= PG_ACCESSED_MASK;
|
|
||||||
x86_stl_phys_notdirty(cs, pml5e_addr, pml5e);
|
|
||||||
}
|
|
||||||
ptep = pml5e ^ PG_NX_MASK;
|
|
||||||
} else {
|
|
||||||
pml5e = env->cr[3];
|
|
||||||
ptep = PG_NX_MASK | PG_USER_MASK | PG_RW_MASK;
|
|
||||||
}
|
|
||||||
|
|
||||||
pml4e_addr = ((pml5e & PG_ADDRESS_MASK) +
|
|
||||||
(((addr >> 39) & 0x1ff) << 3)) & a20_mask;
|
|
||||||
pml4e = x86_ldq_phys(cs, pml4e_addr);
|
|
||||||
if (!(pml4e & PG_PRESENT_MASK)) {
|
|
||||||
goto do_fault;
|
|
||||||
}
|
|
||||||
if (pml4e & (rsvd_mask | PG_PSE_MASK)) {
|
|
||||||
goto do_fault_rsvd;
|
|
||||||
}
|
|
||||||
if (!(pml4e & PG_ACCESSED_MASK)) {
|
|
||||||
pml4e |= PG_ACCESSED_MASK;
|
|
||||||
x86_stl_phys_notdirty(cs, pml4e_addr, pml4e);
|
|
||||||
}
|
|
||||||
ptep &= pml4e ^ PG_NX_MASK;
|
|
||||||
pdpe_addr = ((pml4e & PG_ADDRESS_MASK) + (((addr >> 30) & 0x1ff) << 3)) &
|
|
||||||
a20_mask;
|
|
||||||
pdpe = x86_ldq_phys(cs, pdpe_addr);
|
|
||||||
if (!(pdpe & PG_PRESENT_MASK)) {
|
|
||||||
goto do_fault;
|
|
||||||
}
|
|
||||||
if (pdpe & rsvd_mask) {
|
|
||||||
goto do_fault_rsvd;
|
|
||||||
}
|
|
||||||
ptep &= pdpe ^ PG_NX_MASK;
|
|
||||||
if (!(pdpe & PG_ACCESSED_MASK)) {
|
|
||||||
pdpe |= PG_ACCESSED_MASK;
|
|
||||||
x86_stl_phys_notdirty(cs, pdpe_addr, pdpe);
|
|
||||||
}
|
|
||||||
if (pdpe & PG_PSE_MASK) {
|
|
||||||
/* 1 GB page */
|
|
||||||
page_size = 1024 * 1024 * 1024;
|
|
||||||
pte_addr = pdpe_addr;
|
|
||||||
pte = pdpe;
|
|
||||||
goto do_check_protect;
|
|
||||||
}
|
|
||||||
} else
|
|
||||||
#endif
|
|
||||||
{
|
|
||||||
/* XXX: load them when cr3 is loaded ? */
|
|
||||||
pdpe_addr = ((env->cr[3] & ~0x1f) + ((addr >> 27) & 0x18)) &
|
|
||||||
a20_mask;
|
|
||||||
pdpe = x86_ldq_phys(cs, pdpe_addr);
|
|
||||||
if (!(pdpe & PG_PRESENT_MASK)) {
|
|
||||||
goto do_fault;
|
|
||||||
}
|
|
||||||
rsvd_mask |= PG_HI_USER_MASK;
|
|
||||||
if (pdpe & (rsvd_mask | PG_NX_MASK)) {
|
|
||||||
goto do_fault_rsvd;
|
|
||||||
}
|
|
||||||
ptep = PG_NX_MASK | PG_USER_MASK | PG_RW_MASK;
|
|
||||||
}
|
|
||||||
|
|
||||||
pde_addr = ((pdpe & PG_ADDRESS_MASK) + (((addr >> 21) & 0x1ff) << 3)) &
|
|
||||||
a20_mask;
|
|
||||||
pde = x86_ldq_phys(cs, pde_addr);
|
|
||||||
if (!(pde & PG_PRESENT_MASK)) {
|
|
||||||
goto do_fault;
|
|
||||||
}
|
|
||||||
if (pde & rsvd_mask) {
|
|
||||||
goto do_fault_rsvd;
|
|
||||||
}
|
|
||||||
ptep &= pde ^ PG_NX_MASK;
|
|
||||||
if (pde & PG_PSE_MASK) {
|
|
||||||
/* 2 MB page */
|
|
||||||
page_size = 2048 * 1024;
|
|
||||||
pte_addr = pde_addr;
|
|
||||||
pte = pde;
|
|
||||||
goto do_check_protect;
|
|
||||||
}
|
|
||||||
/* 4 KB page */
|
|
||||||
if (!(pde & PG_ACCESSED_MASK)) {
|
|
||||||
pde |= PG_ACCESSED_MASK;
|
|
||||||
x86_stl_phys_notdirty(cs, pde_addr, pde);
|
|
||||||
}
|
|
||||||
pte_addr = ((pde & PG_ADDRESS_MASK) + (((addr >> 12) & 0x1ff) << 3)) &
|
|
||||||
a20_mask;
|
|
||||||
pte = x86_ldq_phys(cs, pte_addr);
|
|
||||||
if (!(pte & PG_PRESENT_MASK)) {
|
|
||||||
goto do_fault;
|
|
||||||
}
|
|
||||||
if (pte & rsvd_mask) {
|
|
||||||
goto do_fault_rsvd;
|
|
||||||
}
|
|
||||||
/* combine pde and pte nx, user and rw protections */
|
|
||||||
ptep &= pte ^ PG_NX_MASK;
|
|
||||||
page_size = 4096;
|
|
||||||
} else {
|
|
||||||
uint32_t pde;
|
|
||||||
|
|
||||||
/* page directory entry */
|
|
||||||
pde_addr = ((env->cr[3] & ~0xfff) + ((addr >> 20) & 0xffc)) &
|
|
||||||
a20_mask;
|
|
||||||
pde = x86_ldl_phys(cs, pde_addr);
|
|
||||||
if (!(pde & PG_PRESENT_MASK)) {
|
|
||||||
goto do_fault;
|
|
||||||
}
|
|
||||||
ptep = pde | PG_NX_MASK;
|
|
||||||
|
|
||||||
/* if PSE bit is set, then we use a 4MB page */
|
|
||||||
if ((pde & PG_PSE_MASK) && (env->cr[4] & CR4_PSE_MASK)) {
|
|
||||||
page_size = 4096 * 1024;
|
|
||||||
pte_addr = pde_addr;
|
|
||||||
|
|
||||||
/* Bits 20-13 provide bits 39-32 of the address, bit 21 is reserved.
|
|
||||||
* Leave bits 20-13 in place for setting accessed/dirty bits below.
|
|
||||||
*/
|
|
||||||
pte = pde | ((pde & 0x1fe000LL) << (32 - 13));
|
|
||||||
rsvd_mask = 0x200000;
|
|
||||||
goto do_check_protect_pse36;
|
|
||||||
}
|
|
||||||
|
|
||||||
if (!(pde & PG_ACCESSED_MASK)) {
|
|
||||||
pde |= PG_ACCESSED_MASK;
|
|
||||||
x86_stl_phys_notdirty(cs, pde_addr, pde);
|
|
||||||
}
|
|
||||||
|
|
||||||
/* page directory entry */
|
|
||||||
pte_addr = ((pde & ~0xfff) + ((addr >> 10) & 0xffc)) &
|
|
||||||
a20_mask;
|
|
||||||
pte = x86_ldl_phys(cs, pte_addr);
|
|
||||||
if (!(pte & PG_PRESENT_MASK)) {
|
|
||||||
goto do_fault;
|
|
||||||
}
|
|
||||||
/* combine pde and pte user and rw protections */
|
|
||||||
ptep &= pte | PG_NX_MASK;
|
|
||||||
page_size = 4096;
|
|
||||||
rsvd_mask = 0;
|
|
||||||
}
|
|
||||||
|
|
||||||
do_check_protect:
|
|
||||||
rsvd_mask |= (page_size - 1) & PG_ADDRESS_MASK & ~PG_PSE_PAT_MASK;
|
|
||||||
do_check_protect_pse36:
|
|
||||||
if (pte & rsvd_mask) {
|
|
||||||
goto do_fault_rsvd;
|
|
||||||
}
|
|
||||||
ptep ^= PG_NX_MASK;
|
|
||||||
|
|
||||||
/* can the page can be put in the TLB? prot will tell us */
|
|
||||||
if (is_user && !(ptep & PG_USER_MASK)) {
|
|
||||||
goto do_fault_protect;
|
|
||||||
}
|
|
||||||
|
|
||||||
prot = 0;
|
|
||||||
if (mmu_idx != MMU_KSMAP_IDX || !(ptep & PG_USER_MASK)) {
|
|
||||||
prot |= PAGE_READ;
|
|
||||||
if ((ptep & PG_RW_MASK) || (!is_user && !(env->cr[0] & CR0_WP_MASK))) {
|
|
||||||
prot |= PAGE_WRITE;
|
|
||||||
}
|
|
||||||
}
|
|
||||||
if (!(ptep & PG_NX_MASK) &&
|
|
||||||
(mmu_idx == MMU_USER_IDX ||
|
|
||||||
!((env->cr[4] & CR4_SMEP_MASK) && (ptep & PG_USER_MASK)))) {
|
|
||||||
prot |= PAGE_EXEC;
|
|
||||||
}
|
|
||||||
if ((env->cr[4] & CR4_PKE_MASK) && (env->hflags & HF_LMA_MASK) &&
|
|
||||||
(ptep & PG_USER_MASK) && env->pkru) {
|
|
||||||
uint32_t pk = (pte & PG_PKRU_MASK) >> PG_PKRU_BIT;
|
|
||||||
uint32_t pkru_ad = (env->pkru >> pk * 2) & 1;
|
|
||||||
uint32_t pkru_wd = (env->pkru >> pk * 2) & 2;
|
|
||||||
uint32_t pkru_prot = PAGE_READ | PAGE_WRITE | PAGE_EXEC;
|
|
||||||
|
|
||||||
if (pkru_ad) {
|
|
||||||
pkru_prot &= ~(PAGE_READ | PAGE_WRITE);
|
|
||||||
} else if (pkru_wd && (is_user || env->cr[0] & CR0_WP_MASK)) {
|
|
||||||
pkru_prot &= ~PAGE_WRITE;
|
|
||||||
}
|
|
||||||
|
|
||||||
prot &= pkru_prot;
|
|
||||||
if ((pkru_prot & (1 << is_write1)) == 0) {
|
|
||||||
assert(is_write1 != 2);
|
|
||||||
error_code |= PG_ERROR_PK_MASK;
|
|
||||||
goto do_fault_protect;
|
|
||||||
}
|
|
||||||
}
|
|
||||||
|
|
||||||
if ((prot & (1 << is_write1)) == 0) {
|
|
||||||
goto do_fault_protect;
|
|
||||||
}
|
|
||||||
|
|
||||||
/* yes, it can! */
|
|
||||||
is_dirty = is_write && !(pte & PG_DIRTY_MASK);
|
|
||||||
if (!(pte & PG_ACCESSED_MASK) || is_dirty) {
|
|
||||||
pte |= PG_ACCESSED_MASK;
|
|
||||||
if (is_dirty) {
|
|
||||||
pte |= PG_DIRTY_MASK;
|
|
||||||
}
|
|
||||||
x86_stl_phys_notdirty(cs, pte_addr, pte);
|
|
||||||
}
|
|
||||||
|
|
||||||
if (!(pte & PG_DIRTY_MASK)) {
|
|
||||||
/* only set write access if already dirty... otherwise wait
|
|
||||||
for dirty access */
|
|
||||||
assert(!is_write);
|
|
||||||
prot &= ~PAGE_WRITE;
|
|
||||||
}
|
|
||||||
|
|
||||||
do_mapping:
|
|
||||||
pte = pte & a20_mask;
|
|
||||||
|
|
||||||
/* align to page_size */
|
|
||||||
pte &= PG_ADDRESS_MASK & ~(page_size - 1);
|
|
||||||
|
|
||||||
/* Even if 4MB pages, we map only one 4KB page in the cache to
|
|
||||||
avoid filling it too fast */
|
|
||||||
vaddr = addr & TARGET_PAGE_MASK;
|
|
||||||
page_offset = vaddr & (page_size - 1);
|
|
||||||
paddr = pte + page_offset;
|
|
||||||
|
|
||||||
assert(prot & (1 << is_write1));
|
|
||||||
tlb_set_page_with_attrs(cs, vaddr, paddr, cpu_get_mem_attrs(env),
|
|
||||||
prot, mmu_idx, page_size);
|
|
||||||
return 0;
|
|
||||||
do_fault_rsvd:
|
|
||||||
error_code |= PG_ERROR_RSVD_MASK;
|
|
||||||
do_fault_protect:
|
|
||||||
error_code |= PG_ERROR_P_MASK;
|
|
||||||
do_fault:
|
|
||||||
error_code |= (is_write << PG_ERROR_W_BIT);
|
|
||||||
if (is_user)
|
|
||||||
error_code |= PG_ERROR_U_MASK;
|
|
||||||
if (is_write1 == 2 &&
|
|
||||||
(((env->efer & MSR_EFER_NXE) &&
|
|
||||||
(env->cr[4] & CR4_PAE_MASK)) ||
|
|
||||||
(env->cr[4] & CR4_SMEP_MASK)))
|
|
||||||
error_code |= PG_ERROR_I_D_MASK;
|
|
||||||
if (env->intercept_exceptions & (1 << EXCP0E_PAGE)) {
|
|
||||||
/* cr2 is not modified in case of exceptions */
|
|
||||||
x86_stq_phys(cs,
|
|
||||||
env->vm_vmcb + offsetof(struct vmcb, control.exit_info_2),
|
|
||||||
addr);
|
|
||||||
} else {
|
|
||||||
env->cr[2] = addr;
|
|
||||||
}
|
|
||||||
env->error_code = error_code;
|
|
||||||
cs->exception_index = EXCP0E_PAGE;
|
|
||||||
return 1;
|
|
||||||
}
|
|
||||||
|
|
||||||
hwaddr x86_cpu_get_phys_page_debug(CPUState *cs, vaddr addr)
|
hwaddr x86_cpu_get_phys_page_debug(CPUState *cs, vaddr addr)
|
||||||
{
|
{
|
||||||
X86CPU *cpu = X86_CPU(cs);
|
X86CPU *cpu = X86_CPU(cs);
|
||||||
|
|
|
||||||
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