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target/arm: Delete dead code from disas_simd_indexed
MLA, MLS, SQDMULH, SQRDMULH, were converted with8db93dcd3dandf80701cb44, and this code should have been removed then. Signed-off-by: Richard Henderson <richard.henderson@linaro.org> Message-id: 20240625183536.1672454-14-richard.henderson@linaro.org Signed-off-by: Peter Maydell <peter.maydell@linaro.org> Reviewed-by: Peter Maydell <peter.maydell@linaro.org>
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Peter Maydell
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80b02a565e
commit
2cd5078d57
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@ -11976,7 +11976,6 @@ static void disas_simd_indexed(DisasContext *s, uint32_t insn)
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int h = extract32(insn, 11, 1);
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int h = extract32(insn, 11, 1);
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int rn = extract32(insn, 5, 5);
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int rn = extract32(insn, 5, 5);
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int rd = extract32(insn, 0, 5);
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int rd = extract32(insn, 0, 5);
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bool is_long = false;
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int index;
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int index;
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switch (16 * u + opcode) {
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switch (16 * u + opcode) {
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@ -11990,12 +11989,10 @@ static void disas_simd_indexed(DisasContext *s, uint32_t insn)
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unallocated_encoding(s);
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unallocated_encoding(s);
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return;
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return;
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}
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}
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is_long = true;
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break;
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break;
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case 0x03: /* SQDMLAL, SQDMLAL2 */
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case 0x03: /* SQDMLAL, SQDMLAL2 */
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case 0x07: /* SQDMLSL, SQDMLSL2 */
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case 0x07: /* SQDMLSL, SQDMLSL2 */
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||||||
case 0x0b: /* SQDMULL, SQDMULL2 */
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case 0x0b: /* SQDMULL, SQDMULL2 */
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is_long = true;
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break;
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break;
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default:
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default:
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case 0x00: /* FMLAL */
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case 0x00: /* FMLAL */
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@ -12047,96 +12044,6 @@ static void disas_simd_indexed(DisasContext *s, uint32_t insn)
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if (size == 3) {
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if (size == 3) {
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g_assert_not_reached();
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g_assert_not_reached();
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} else if (!is_long) {
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/* 32 bit floating point, or 16 or 32 bit integer.
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* For the 16 bit scalar case we use the usual Neon helpers and
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* rely on the fact that 0 op 0 == 0 with no side effects.
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*/
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TCGv_i32 tcg_idx = tcg_temp_new_i32();
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int pass, maxpasses;
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if (is_scalar) {
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maxpasses = 1;
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} else {
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maxpasses = is_q ? 4 : 2;
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}
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read_vec_element_i32(s, tcg_idx, rm, index, size);
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if (size == 1 && !is_scalar) {
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/* The simplest way to handle the 16x16 indexed ops is to duplicate
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* the index into both halves of the 32 bit tcg_idx and then use
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* the usual Neon helpers.
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*/
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tcg_gen_deposit_i32(tcg_idx, tcg_idx, tcg_idx, 16, 16);
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}
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for (pass = 0; pass < maxpasses; pass++) {
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TCGv_i32 tcg_op = tcg_temp_new_i32();
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TCGv_i32 tcg_res = tcg_temp_new_i32();
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read_vec_element_i32(s, tcg_op, rn, pass, is_scalar ? size : MO_32);
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switch (16 * u + opcode) {
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case 0x10: /* MLA */
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case 0x14: /* MLS */
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{
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static NeonGenTwoOpFn * const fns[2][2] = {
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{ gen_helper_neon_add_u16, gen_helper_neon_sub_u16 },
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{ tcg_gen_add_i32, tcg_gen_sub_i32 },
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};
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NeonGenTwoOpFn *genfn;
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bool is_sub = opcode == 0x4;
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if (size == 1) {
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gen_helper_neon_mul_u16(tcg_res, tcg_op, tcg_idx);
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} else {
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tcg_gen_mul_i32(tcg_res, tcg_op, tcg_idx);
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}
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if (opcode == 0x8) {
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break;
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}
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read_vec_element_i32(s, tcg_op, rd, pass, MO_32);
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genfn = fns[size - 1][is_sub];
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genfn(tcg_res, tcg_op, tcg_res);
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break;
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}
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case 0x0c: /* SQDMULH */
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if (size == 1) {
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gen_helper_neon_qdmulh_s16(tcg_res, tcg_env,
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||||||
tcg_op, tcg_idx);
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} else {
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||||||
gen_helper_neon_qdmulh_s32(tcg_res, tcg_env,
|
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||||||
tcg_op, tcg_idx);
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}
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break;
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case 0x0d: /* SQRDMULH */
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||||||
if (size == 1) {
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||||||
gen_helper_neon_qrdmulh_s16(tcg_res, tcg_env,
|
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||||||
tcg_op, tcg_idx);
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||||||
} else {
|
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||||||
gen_helper_neon_qrdmulh_s32(tcg_res, tcg_env,
|
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||||||
tcg_op, tcg_idx);
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}
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break;
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default:
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case 0x01: /* FMLA */
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case 0x05: /* FMLS */
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case 0x09: /* FMUL */
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||||||
case 0x19: /* FMULX */
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||||||
case 0x1d: /* SQRDMLAH */
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case 0x1f: /* SQRDMLSH */
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g_assert_not_reached();
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}
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if (is_scalar) {
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write_fp_sreg(s, rd, tcg_res);
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} else {
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write_vec_element_i32(s, tcg_res, rd, pass, MO_32);
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}
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}
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||||||
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||||||
clear_vec_high(s, is_q, rd);
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||||||
} else {
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} else {
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||||||
/* long ops: 16x16->32 or 32x32->64 */
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/* long ops: 16x16->32 or 32x32->64 */
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TCGv_i64 tcg_res[2];
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TCGv_i64 tcg_res[2];
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