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Util: ppc64 byteswap access fixes
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48bab99ad5
commit
9403a02481
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@ -129,31 +129,32 @@ typedef intptr_t ssize_t;
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#define LOAD_32BE(DEST, ADDR, ARR) DEST = *(uint32_t*) ((uintptr_t) (ARR) + (size_t) (ADDR))
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#if defined(__PPC__) || defined(__POWERPC__)
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#define LOAD_32LE(DEST, ADDR, ARR) { \
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uint32_t _addr = (ADDR); \
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off_t _addr = (ADDR); \
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const void* _ptr = (ARR); \
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__asm__("lwbrx %0, %1, %2" : "=r"(DEST) : "b"(_ptr), "r"(_addr)); \
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}
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#define LOAD_16LE(DEST, ADDR, ARR) { \
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uint32_t _addr = (ADDR); \
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off_t _addr = (ADDR); \
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const void* _ptr = (ARR); \
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__asm__("lhbrx %0, %1, %2" : "=r"(DEST) : "b"(_ptr), "r"(_addr)); \
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}
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#define STORE_32LE(SRC, ADDR, ARR) { \
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uint32_t _addr = (ADDR); \
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off_t _addr = (ADDR); \
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||||
void* _ptr = (ARR); \
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__asm__("stwbrx %0, %1, %2" : : "r"(SRC), "b"(_ptr), "r"(_addr) : "memory"); \
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}
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#define STORE_16LE(SRC, ADDR, ARR) { \
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uint32_t _addr = (ADDR); \
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off_t _addr = (ADDR); \
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||||
void* _ptr = (ARR); \
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__asm__("sthbrx %0, %1, %2" : : "r"(SRC), "b"(_ptr), "r"(_addr) : "memory"); \
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}
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#ifndef _ARCH_PWR7
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#define LOAD_64LE(DEST, ADDR, ARR) { \
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uint32_t _addr = (ADDR); \
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off_t _addr = (ADDR); \
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union { \
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struct { \
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uint32_t hi; \
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@ -170,7 +171,7 @@ typedef intptr_t ssize_t;
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}
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#define STORE_64LE(SRC, ADDR, ARR) { \
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uint32_t _addr = (ADDR); \
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off_t _addr = (ADDR); \
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||||
union { \
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||||
struct { \
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||||
uint32_t hi; \
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@ -184,6 +185,19 @@ typedef intptr_t ssize_t;
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"stwbrx %1, %2, %4 \n" \
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: : "r"(bswap.hi), "r"(bswap.lo), "b"(_ptr), "r"(_addr), "r"(_addr + 4) : "memory"); \
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}
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#else
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#define LOAD_64LE(DEST, ADDR, ARR) { \
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off_t _addr = (ADDR); \
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const void* _ptr = (ARR); \
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__asm__("ldbrx %0, %1, %2" : "=r"(DEST) : "b"(_ptr), "r"(_addr)); \
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||||
}
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||||
#define STORE_64LE(SRC, ADDR, ARR) { \
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||||
off_t _addr = (ADDR); \
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||||
void* _ptr = (ARR); \
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||||
__asm__("stdbrx %0, %1, %2" : : "r"(SRC), "b"(_ptr), "r"(_addr) : "memory"); \
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||||
}
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#endif
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#elif defined(__llvm__) || (__GNUC__ > 4) || (__GNUC__ == 4 && __GNUC_MINOR__ >= 8)
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#define LOAD_64LE(DEST, ADDR, ARR) DEST = __builtin_bswap64(((uint64_t*) ARR)[(ADDR) >> 3])
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