IPC FIFO emulation.
This commit is contained in:
parent
8c2f785a0f
commit
45bceecc19
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@ -0,0 +1,72 @@
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Copyright 2016-2017 StapleButter
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This file is part of melonDS.
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melonDS is free software: you can redistribute it and/or modify it under
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the terms of the GNU General Public License as published by the Free
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Software Foundation, either version 3 of the License, or (at your option)
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any later version.
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melonDS is distributed in the hope that it will be useful, but WITHOUT ANY
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WARRANTY; without even the implied warranty of MERCHANTABILITY or FITNESS
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FOR A PARTICULAR PURPOSE. See the GNU General Public License for more details.
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You should have received a copy of the GNU General Public License along
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with melonDS. If not, see http://www.gnu.org/licenses/.
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#include "FIFO.h"
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FIFO::FIFO(u32 num)
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{
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NumEntries = num;
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Entries = new u32[num];
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Clear();
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}
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FIFO::~FIFO()
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{
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delete[] Entries;
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}
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void FIFO::Clear()
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{
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NumOccupied = 0;
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ReadPos = 0;
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WritePos = 0;
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Entries[ReadPos] = 0;
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}
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void FIFO::Write(u32 val)
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{
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if (IsFull()) return;
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Entries[WritePos] = val;
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WritePos++;
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if (WritePos >= NumEntries)
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WritePos = 0;
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NumOccupied++;
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}
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u32 FIFO::Read()
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{
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u32 ret = Entries[ReadPos];
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if (IsEmpty())
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return ret;
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ReadPos++;
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if (ReadPos >= NumEntries)
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|
ReadPos = 0;
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NumOccupied--;
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return ret;
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}
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u32 FIFO::Peek()
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{
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|
return Entries[ReadPos];
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}
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@ -0,0 +1,47 @@
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/*
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Copyright 2016-2017 StapleButter
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This file is part of melonDS.
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melonDS is free software: you can redistribute it and/or modify it under
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|
the terms of the GNU General Public License as published by the Free
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Software Foundation, either version 3 of the License, or (at your option)
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any later version.
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|
melonDS is distributed in the hope that it will be useful, but WITHOUT ANY
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WARRANTY; without even the implied warranty of MERCHANTABILITY or FITNESS
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|
FOR A PARTICULAR PURPOSE. See the GNU General Public License for more details.
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You should have received a copy of the GNU General Public License along
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with melonDS. If not, see http://www.gnu.org/licenses/.
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#ifndef FIFO_H
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#define FIFO_H
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#include "types.h"
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class FIFO
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{
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public:
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FIFO(u32 num);
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~FIFO();
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void Clear();
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void Write(u32 val);
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u32 Read();
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u32 Peek();
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|
u32 Level() { return NumOccupied; }
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bool IsEmpty() { return NumOccupied == 0; }
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|
bool IsFull() { return NumOccupied >= NumEntries; }
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private:
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u32 NumEntries;
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|
u32* Entries;
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u32 NumOccupied;
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|
u32 ReadPos, WritePos;
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|
};
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||||||
|
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||||||
|
#endif
|
130
NDS.cpp
130
NDS.cpp
|
@ -21,6 +21,7 @@
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||||||
#include "NDS.h"
|
#include "NDS.h"
|
||||||
#include "ARM.h"
|
#include "ARM.h"
|
||||||
#include "CP15.h"
|
#include "CP15.h"
|
||||||
|
#include "FIFO.h"
|
||||||
#include "GPU2D.h"
|
#include "GPU2D.h"
|
||||||
#include "SPI.h"
|
#include "SPI.h"
|
||||||
#include "Wifi.h"
|
#include "Wifi.h"
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||||||
|
@ -35,6 +36,9 @@ namespace SPI_Firmware
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namespace NDS
|
namespace NDS
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{
|
{
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// TODO: stick all the variables in a big structure?
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|
// would make it easier to deal with savestates
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SchedEvent SchedBuffer[SCHED_BUF_LEN];
|
SchedEvent SchedBuffer[SCHED_BUF_LEN];
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SchedEvent* SchedQueue;
|
SchedEvent* SchedQueue;
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|
@ -76,6 +80,9 @@ u16 PowerControl7;
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Timer Timers[8];
|
Timer Timers[8];
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||||||
u16 IPCSync9, IPCSync7;
|
u16 IPCSync9, IPCSync7;
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||||||
|
u16 IPCFIFOCnt9, IPCFIFOCnt7;
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|
FIFO* IPCFIFO9; // FIFO in which the ARM9 writes
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|
FIFO* IPCFIFO7;
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u32 ROMSPIControl;
|
u32 ROMSPIControl;
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u32 ROMControl;
|
u32 ROMControl;
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||||||
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@ -95,6 +102,9 @@ void Init()
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||||||
ARM9 = new ARM(0);
|
ARM9 = new ARM(0);
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ARM7 = new ARM(1);
|
ARM7 = new ARM(1);
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||||||
|
IPCFIFO9 = new FIFO(16);
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||||||
|
IPCFIFO7 = new FIFO(16);
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||||||
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||||||
SPI::Init();
|
SPI::Init();
|
||||||
|
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||||||
Reset();
|
Reset();
|
||||||
|
@ -191,6 +201,10 @@ void Reset()
|
||||||
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||||||
IPCSync9 = 0;
|
IPCSync9 = 0;
|
||||||
IPCSync7 = 0;
|
IPCSync7 = 0;
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||||||
|
IPCFIFOCnt9 = 0;
|
||||||
|
IPCFIFOCnt7 = 0;
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||||||
|
IPCFIFO9->Clear();
|
||||||
|
IPCFIFO7->Clear();
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|
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||||||
ROMSPIControl = 0;
|
ROMSPIControl = 0;
|
||||||
ROMControl = 0;
|
ROMControl = 0;
|
||||||
|
@ -726,6 +740,15 @@ u16 ARM9Read16(u32 addr)
|
||||||
case 0x04000130: return KeyInput & 0xFFFF;
|
case 0x04000130: return KeyInput & 0xFFFF;
|
||||||
|
|
||||||
case 0x04000180: return IPCSync9;
|
case 0x04000180: return IPCSync9;
|
||||||
|
case 0x04000184:
|
||||||
|
{
|
||||||
|
u16 val = IPCFIFOCnt9;
|
||||||
|
if (IPCFIFO9->IsEmpty()) val |= 0x0001;
|
||||||
|
else if (IPCFIFO9->IsFull()) val |= 0x0002;
|
||||||
|
if (IPCFIFO7->IsEmpty()) val |= 0x0100;
|
||||||
|
else if (IPCFIFO7->IsFull()) val |= 0x0200;
|
||||||
|
return val;
|
||||||
|
}
|
||||||
|
|
||||||
case 0x04000204: return 0;//0xFFFF;
|
case 0x04000204: return 0;//0xFFFF;
|
||||||
|
|
||||||
|
@ -815,6 +838,27 @@ u32 ARM9Read32(u32 addr)
|
||||||
case 0x04000208: return IME[0];
|
case 0x04000208: return IME[0];
|
||||||
case 0x04000210: return IE[0];
|
case 0x04000210: return IE[0];
|
||||||
case 0x04000214: return IF[0];
|
case 0x04000214: return IF[0];
|
||||||
|
|
||||||
|
case 0x04100000:
|
||||||
|
if (IPCFIFOCnt9 & 0x8000)
|
||||||
|
{
|
||||||
|
u32 ret;
|
||||||
|
if (IPCFIFO7->IsEmpty())
|
||||||
|
{
|
||||||
|
IPCFIFOCnt9 |= 0x4000;
|
||||||
|
ret = IPCFIFO7->Peek();
|
||||||
|
}
|
||||||
|
else
|
||||||
|
{
|
||||||
|
ret = IPCFIFO7->Read();
|
||||||
|
|
||||||
|
if (IPCFIFO7->IsEmpty() && (IPCFIFOCnt7 & 0x0004))
|
||||||
|
TriggerIRQ(1, IRQ_IPCSendDone);
|
||||||
|
}
|
||||||
|
return ret;
|
||||||
|
}
|
||||||
|
else
|
||||||
|
return IPCFIFO7->Peek();
|
||||||
}
|
}
|
||||||
|
|
||||||
printf("unknown arm9 IO read32 %08X | %08X %08X %08X\n", addr, ARM9->R[15], ARM9->R[12], ARM9Read32(0x027FF820));
|
printf("unknown arm9 IO read32 %08X | %08X %08X %08X\n", addr, ARM9->R[15], ARM9->R[12], ARM9Read32(0x027FF820));
|
||||||
|
@ -955,6 +999,18 @@ void ARM9Write16(u32 addr, u16 val)
|
||||||
CompensateARM7();
|
CompensateARM7();
|
||||||
return;
|
return;
|
||||||
|
|
||||||
|
case 0x04000184:
|
||||||
|
if (val & 0x0008)
|
||||||
|
IPCFIFO9->Clear();
|
||||||
|
if ((val & 0x0004) && (!(IPCFIFOCnt9 & 0x0004)) && IPCFIFO9->IsEmpty())
|
||||||
|
TriggerIRQ(0, IRQ_IPCSendDone);
|
||||||
|
if ((val & 0x0400) && (!(IPCFIFOCnt9 & 0x0400)) && (!IPCFIFO7->IsEmpty()))
|
||||||
|
TriggerIRQ(0, IRQ_IPCRecv);
|
||||||
|
if (val & 0x4000)
|
||||||
|
IPCFIFOCnt9 &= ~0x4000;
|
||||||
|
IPCFIFOCnt9 = val & 0x8404;
|
||||||
|
return;
|
||||||
|
|
||||||
case 0x040001A0:
|
case 0x040001A0:
|
||||||
ROMSPIControl = val;
|
ROMSPIControl = val;
|
||||||
return;
|
return;
|
||||||
|
@ -1061,6 +1117,20 @@ void ARM9Write32(u32 addr, u32 val)
|
||||||
TimerStart(3, val>>16);
|
TimerStart(3, val>>16);
|
||||||
return;
|
return;
|
||||||
|
|
||||||
|
case 0x04000188:
|
||||||
|
if (IPCFIFOCnt9 & 0x8000)
|
||||||
|
{
|
||||||
|
if (IPCFIFO9->IsFull())
|
||||||
|
IPCFIFOCnt9 |= 0x4000;
|
||||||
|
else
|
||||||
|
{
|
||||||
|
IPCFIFO9->Write(val);
|
||||||
|
if (IPCFIFOCnt7 & 0x0400)
|
||||||
|
TriggerIRQ(1, IRQ_IPCRecv);
|
||||||
|
}
|
||||||
|
}
|
||||||
|
return;
|
||||||
|
|
||||||
case 0x040001A0:
|
case 0x040001A0:
|
||||||
ROMSPIControl = val & 0xFFFF;
|
ROMSPIControl = val & 0xFFFF;
|
||||||
// TODO: SPI shit
|
// TODO: SPI shit
|
||||||
|
@ -1160,6 +1230,10 @@ u8 ARM7Read8(u32 addr)
|
||||||
case 0x04000300:
|
case 0x04000300:
|
||||||
printf("ARM7 POSTFLG READ @ %08X\n", ARM7->R[15]);
|
printf("ARM7 POSTFLG READ @ %08X\n", ARM7->R[15]);
|
||||||
return 0;
|
return 0;
|
||||||
|
|
||||||
|
case 0x04000403:
|
||||||
|
Halt();
|
||||||
|
return 0;
|
||||||
}
|
}
|
||||||
printf("unknown arm7 IO read8 %08X\n", addr);
|
printf("unknown arm7 IO read8 %08X\n", addr);
|
||||||
return 0;
|
return 0;
|
||||||
|
@ -1221,6 +1295,15 @@ u16 ARM7Read16(u32 addr)
|
||||||
case 0x04000138: return 0; // RTC shit
|
case 0x04000138: return 0; // RTC shit
|
||||||
|
|
||||||
case 0x04000180: return IPCSync7;
|
case 0x04000180: return IPCSync7;
|
||||||
|
case 0x04000184:
|
||||||
|
{
|
||||||
|
u16 val = IPCFIFOCnt7;
|
||||||
|
if (IPCFIFO7->IsEmpty()) val |= 0x0001;
|
||||||
|
else if (IPCFIFO7->IsFull()) val |= 0x0002;
|
||||||
|
if (IPCFIFO9->IsEmpty()) val |= 0x0100;
|
||||||
|
else if (IPCFIFO9->IsFull()) val |= 0x0200;
|
||||||
|
return val;
|
||||||
|
}
|
||||||
|
|
||||||
case 0x040001C0: return SPI::ReadCnt();
|
case 0x040001C0: return SPI::ReadCnt();
|
||||||
case 0x040001C2: return SPI::ReadData();
|
case 0x040001C2: return SPI::ReadData();
|
||||||
|
@ -1298,6 +1381,27 @@ u32 ARM7Read32(u32 addr)
|
||||||
case 0x04000210: return IE[1];
|
case 0x04000210: return IE[1];
|
||||||
case 0x04000214: return IF[1];
|
case 0x04000214: return IF[1];
|
||||||
|
|
||||||
|
case 0x04100000:
|
||||||
|
if (IPCFIFOCnt7 & 0x8000)
|
||||||
|
{
|
||||||
|
u32 ret;
|
||||||
|
if (IPCFIFO9->IsEmpty())
|
||||||
|
{
|
||||||
|
IPCFIFOCnt7 |= 0x4000;
|
||||||
|
ret = IPCFIFO9->Peek();
|
||||||
|
}
|
||||||
|
else
|
||||||
|
{
|
||||||
|
ret = IPCFIFO9->Read();
|
||||||
|
|
||||||
|
if (IPCFIFO9->IsEmpty() && (IPCFIFOCnt9 & 0x0004))
|
||||||
|
TriggerIRQ(0, IRQ_IPCSendDone);
|
||||||
|
}
|
||||||
|
return ret;
|
||||||
|
}
|
||||||
|
else
|
||||||
|
return IPCFIFO9->Peek();
|
||||||
|
|
||||||
case 0x04100010: return ROMReadData(1);
|
case 0x04100010: return ROMReadData(1);
|
||||||
}
|
}
|
||||||
|
|
||||||
|
@ -1458,6 +1562,18 @@ void ARM7Write16(u32 addr, u16 val)
|
||||||
}
|
}
|
||||||
return;
|
return;
|
||||||
|
|
||||||
|
case 0x04000184:
|
||||||
|
if (val & 0x0008)
|
||||||
|
IPCFIFO7->Clear();
|
||||||
|
if ((val & 0x0004) && (!(IPCFIFOCnt7 & 0x0004)) && IPCFIFO7->IsEmpty())
|
||||||
|
TriggerIRQ(1, IRQ_IPCSendDone);
|
||||||
|
if ((val & 0x0400) && (!(IPCFIFOCnt7 & 0x0400)) && (!IPCFIFO9->IsEmpty()))
|
||||||
|
TriggerIRQ(1, IRQ_IPCRecv);
|
||||||
|
if (val & 0x4000)
|
||||||
|
IPCFIFOCnt7 &= ~0x4000;
|
||||||
|
IPCFIFOCnt7 = val & 0x8404;
|
||||||
|
return;
|
||||||
|
|
||||||
case 0x040001A0:
|
case 0x040001A0:
|
||||||
ROMSPIControl = val;
|
ROMSPIControl = val;
|
||||||
return;
|
return;
|
||||||
|
@ -1540,6 +1656,20 @@ void ARM7Write32(u32 addr, u32 val)
|
||||||
TimerStart(7, val>>16);
|
TimerStart(7, val>>16);
|
||||||
return;
|
return;
|
||||||
|
|
||||||
|
case 0x04000188:
|
||||||
|
if (IPCFIFOCnt7 & 0x8000)
|
||||||
|
{
|
||||||
|
if (IPCFIFO7->IsFull())
|
||||||
|
IPCFIFOCnt7 |= 0x4000;
|
||||||
|
else
|
||||||
|
{
|
||||||
|
IPCFIFO7->Write(val);
|
||||||
|
if (IPCFIFOCnt9 & 0x0400)
|
||||||
|
TriggerIRQ(0, IRQ_IPCRecv);
|
||||||
|
}
|
||||||
|
}
|
||||||
|
return;
|
||||||
|
|
||||||
case 0x040001A0:
|
case 0x040001A0:
|
||||||
ROMSPIControl = val & 0xFFFF;
|
ROMSPIControl = val & 0xFFFF;
|
||||||
// TODO: SPI shit
|
// TODO: SPI shit
|
||||||
|
|
|
@ -48,6 +48,8 @@
|
||||||
<Unit filename="ARM_InstrTable.h" />
|
<Unit filename="ARM_InstrTable.h" />
|
||||||
<Unit filename="CP15.cpp" />
|
<Unit filename="CP15.cpp" />
|
||||||
<Unit filename="CP15.h" />
|
<Unit filename="CP15.h" />
|
||||||
|
<Unit filename="FIFO.cpp" />
|
||||||
|
<Unit filename="FIFO.h" />
|
||||||
<Unit filename="GPU2D.cpp" />
|
<Unit filename="GPU2D.cpp" />
|
||||||
<Unit filename="GPU2D.h" />
|
<Unit filename="GPU2D.h" />
|
||||||
<Unit filename="NDS.cpp" />
|
<Unit filename="NDS.cpp" />
|
||||||
|
|
|
@ -10,12 +10,13 @@
|
||||||
|
|
||||||
1481161027 c:\documents\sources\melonds\types.h
|
1481161027 c:\documents\sources\melonds\types.h
|
||||||
|
|
||||||
1484538142 source:c:\documents\sources\melonds\nds.cpp
|
1484614470 source:c:\documents\sources\melonds\nds.cpp
|
||||||
<stdio.h>
|
<stdio.h>
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<string.h>
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<string.h>
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"NDS.h"
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"NDS.h"
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"ARM.h"
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"ARM.h"
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"CP15.h"
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"CP15.h"
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"FIFO.h"
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"GPU2D.h"
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"GPU2D.h"
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"SPI.h"
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"SPI.h"
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"Wifi.h"
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"Wifi.h"
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@ -95,3 +96,9 @@
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"NDS.h"
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"NDS.h"
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"Wifi.h"
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"Wifi.h"
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1484613078 source:c:\documents\sources\melonds\fifo.cpp
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"FIFO.h"
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1484612398 c:\documents\sources\melonds\fifo.h
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"types.h"
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