[ARM] Implement LFD. Reorder VFP register allocation a bit.
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dc66b3d474
commit
86826b28dc
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@ -189,6 +189,7 @@ public:
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// Floating point loadStore
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void lfs(UGeckoInstruction _inst);
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void lfd(UGeckoInstruction _inst);
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};
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#endif // _JIT64_H
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@ -53,20 +53,51 @@ void JitArm::lfs(UGeckoInstruction inst)
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else
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MOVI2R(rB, (u32)inst.SIMM_16);
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MOVI2R(rA, (u32)&Memory::Read_U32);
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PUSH(4, R0, R1, R2, R3);
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MOV(R0, rB);
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BL(rA);
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MOV(rA, R0);
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||||
POP(4, R0, R1, R2, R3);
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ARMReg v0 = fpr.R0(inst.FD, false);
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||||
ARMReg v1 = fpr.R1(inst.FD, false);
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||||
VMOV(v0, rA, false);
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VMOV(v1, rA, false);
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||||
MOVI2R(rA, (u32)&Memory::Read_F32);
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||||
PUSH(4, R0, R1, R2, R3);
|
||||
MOV(R0, rB);
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||||
BL(rA);
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// XXX: Need to use VCVT here.
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VMOV(v0, D0);
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||||
VMOV(v1, D0);
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POP(4, R0, R1, R2, R3);
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||||
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||||
gpr.Unlock(rA, rB);
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SetJumpTarget(DoNotLoad);
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}
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void JitArm::lfd(UGeckoInstruction inst)
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{
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INSTRUCTION_START
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JITDISABLE(LoadStoreFloating)
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||||
ARMReg rA = gpr.GetReg();
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||||
ARMReg rB = gpr.GetReg();
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||||
LDR(rA, R9, PPCSTATE_OFF(Exceptions));
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||||
CMP(rA, EXCEPTION_DSI);
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||||
FixupBranch DoNotLoad = B_CC(CC_EQ);
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||||
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||||
if (inst.RA)
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{
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MOVI2R(rB, inst.SIMM_16);
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||||
ARMReg RA = gpr.R(inst.RA);
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||||
ADD(rB, rB, RA);
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||||
}
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||||
else
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||||
MOVI2R(rB, (u32)inst.SIMM_16);
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||||
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||||
ARMReg v0 = fpr.R0(inst.FD, false);
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||||
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||||
MOVI2R(rA, (u32)&Memory::Read_F64);
|
||||
PUSH(4, R0, R1, R2, R3);
|
||||
MOV(R0, rB);
|
||||
BL(rA);
|
||||
VMOV(v0, D0);
|
||||
POP(4, R0, R1, R2, R3);
|
||||
|
||||
gpr.Unlock(rA, rB);
|
||||
SetJumpTarget(DoNotLoad);
|
||||
}
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@ -99,7 +99,7 @@ static GekkoOPTemplate primarytable[] =
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{48, &JitArm::lfs}, //"lfs", OPTYPE_LOADFP, FL_IN_A}},
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||||
{49, &JitArm::Default}, //"lfsu", OPTYPE_LOADFP, FL_OUT_A | FL_IN_A}},
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||||
{50, &JitArm::Default}, //"lfd", OPTYPE_LOADFP, FL_IN_A}},
|
||||
{50, &JitArm::lfd}, //"lfd", OPTYPE_LOADFP, FL_IN_A}},
|
||||
{51, &JitArm::Default}, //"lfdu", OPTYPE_LOADFP, FL_OUT_A | FL_IN_A}},
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||||
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||||
{52, &JitArm::Default}, //"stfs", OPTYPE_STOREFP, FL_IN_A}},
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@ -56,9 +56,9 @@ ARMReg *ArmFPRCache::GetPPCAllocationOrder(int &count)
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// the ppc side.
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||||
static ARMReg allocationOrder[] =
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{
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||||
D0, D1, D2, D3, D4, D5, D6, D7, D8, D9, D10,
|
||||
D11, D12, D13, D14, D15, D16, D17, D18, D19,
|
||||
D20, D21, D22, D23, D24, D25, D26, D27
|
||||
D4, D5, D6, D7, D8, D9, D10, D11, D12, D13,
|
||||
D14, D15, D16, D17, D18, D19, D20, D21, D22,
|
||||
D23, D24, D25, D26, D27, D28, D29, D30, D31
|
||||
};
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||||
count = sizeof(allocationOrder) / sizeof(const int);
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||||
return allocationOrder;
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@ -69,7 +69,7 @@ ARMReg *ArmFPRCache::GetAllocationOrder(int &count)
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// the host side.
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static ARMReg allocationOrder[] =
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{
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||||
D31, D30, D29, D28
|
||||
D0, D1, D2, D3
|
||||
};
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||||
count = sizeof(allocationOrder) / sizeof(const int);
|
||||
return allocationOrder;
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||||
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