DSPLLE added carry and overflow now we (lordmark) should add them in
the right ops ;) git-svn-id: https://dolphin-emu.googlecode.com/svn/trunk@4222 8ced0084-cf51-0410-be5f-012b33b47a6e
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4c36a5280c
commit
49601e0af2
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@ -26,7 +26,7 @@
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namespace DSPInterpreter {
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void Update_SR_Register64(s64 _Value)
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void Update_SR_Register64(s64 _Value, bool carry, bool overflow)
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{
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// TODO: Should also set 0x10 and 0x01 (also 0x02?)
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g_dsp.r[DSP_REG_SR] &= ~SR_CMP_MASK;
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@ -41,6 +41,16 @@ void Update_SR_Register64(s64 _Value)
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g_dsp.r[DSP_REG_SR] |= SR_ARITH_ZERO;
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}
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if (carry)
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{
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g_dsp.r[DSP_REG_SR] |= SR_CARRY;
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}
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if (overflow)
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{
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g_dsp.r[DSP_REG_SR] |= SR_OVERFLOW;
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}
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// Checks if top bits are equal, what is it good for?
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if (((_Value >> 62) == 0) || (_Value >> 62 == 3))
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{
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@ -49,11 +59,10 @@ void Update_SR_Register64(s64 _Value)
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}
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void Update_SR_Register16(s16 _Value)
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void Update_SR_Register16(s16 _Value, bool carry, bool overflow)
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{
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g_dsp.r[DSP_REG_SR] &= ~SR_CMP_MASK;
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// Only sets those 3 bits
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if (_Value < 0)
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{
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@ -65,6 +74,16 @@ void Update_SR_Register16(s16 _Value)
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g_dsp.r[DSP_REG_SR] |= SR_ARITH_ZERO;
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}
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if (carry)
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{
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g_dsp.r[DSP_REG_SR] |= SR_CARRY;
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}
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if (overflow)
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{
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g_dsp.r[DSP_REG_SR] |= SR_OVERFLOW;
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}
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// Checks if top bits are equal, what is it good for?
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if (((_Value >> 14) == 0) || ((_Value >> 14) == 3))
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{
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@ -30,10 +30,22 @@ bool CheckCondition(u8 _Condition);
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int GetMultiplyModifier();
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void Update_SR_Register16(s16 _Value);
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void Update_SR_Register64(s64 _Value);
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void Update_SR_Register16(s16 _Value, bool carry = false, bool overflow = false);
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void Update_SR_Register64(s64 _Value, bool carry = false, bool overflow = false);
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void Update_SR_LZ(s64 value);
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inline bool isAddCarry(u64 val, u64 result) {
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return (val > result);
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}
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inline bool isSubCarry(u64 val, u64 result) {
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return (val < result);
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}
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inline bool isOverflow(s64 val1, s64 val2, s64 res) {
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return ((val1 ^ res) & (val2 ^ res)) < 0;
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}
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} // namespace
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#endif // _GDSP_CONDITION_CODES_H
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Reference in New Issue