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555 lines
16 KiB
C++
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16 KiB
C++
#ifdef SA1_CPP
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//(CCNT) SA-1 control
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void SA1::mmio_w2200(uint8 data) {
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if(mmio.sa1_resb && !(data & 0x80)) {
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//reset SA-1 CPU
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regs.pc.w = mmio.crv;
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regs.pc.b = 0x00;
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}
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mmio.sa1_irq = (data & 0x80);
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mmio.sa1_rdyb = (data & 0x40);
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mmio.sa1_resb = (data & 0x20);
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mmio.sa1_nmi = (data & 0x10);
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mmio.smeg = (data & 0x0f);
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if(mmio.sa1_irq) {
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mmio.sa1_irqfl = true;
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if(mmio.sa1_irqen) mmio.sa1_irqcl = 0;
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}
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if(mmio.sa1_nmi) {
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mmio.sa1_nmifl = true;
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if(mmio.sa1_nmien) mmio.sa1_nmicl = 0;
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}
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}
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//(SIE) S-CPU interrupt enable
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void SA1::mmio_w2201(uint8 data) {
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if(!mmio.cpu_irqen && (data & 0x80)) {
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if(mmio.cpu_irqfl) {
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mmio.cpu_irqcl = 0;
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cpu.regs.irq = 1;
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}
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}
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if(!mmio.chdma_irqen && (data & 0x20)) {
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if(mmio.chdma_irqfl) {
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mmio.chdma_irqcl = 0;
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cpu.regs.irq = 1;
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}
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}
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mmio.cpu_irqen = (data & 0x80);
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mmio.chdma_irqen = (data & 0x20);
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}
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//(SIC) S-CPU interrupt clear
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void SA1::mmio_w2202(uint8 data) {
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mmio.cpu_irqcl = (data & 0x80);
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mmio.chdma_irqcl = (data & 0x20);
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if(mmio.cpu_irqcl ) mmio.cpu_irqfl = false;
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if(mmio.chdma_irqcl) mmio.chdma_irqfl = false;
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if(!mmio.cpu_irqfl && !mmio.chdma_irqfl) cpu.regs.irq = 0;
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}
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//(CRV) SA-1 reset vector
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void SA1::mmio_w2203(uint8 data) { mmio.crv = (mmio.crv & 0xff00) | data; }
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void SA1::mmio_w2204(uint8 data) { mmio.crv = (data << 8) | (mmio.crv & 0xff); }
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//(CNV) SA-1 NMI vector
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void SA1::mmio_w2205(uint8 data) { mmio.cnv = (mmio.cnv & 0xff00) | data; }
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void SA1::mmio_w2206(uint8 data) { mmio.cnv = (data << 8) | (mmio.cnv & 0xff); }
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//(CIV) SA-1 IRQ vector
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void SA1::mmio_w2207(uint8 data) { mmio.civ = (mmio.civ & 0xff00) | data; }
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void SA1::mmio_w2208(uint8 data) { mmio.civ = (data << 8) | (mmio.civ & 0xff); }
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//(SCNT) S-CPU control
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void SA1::mmio_w2209(uint8 data) {
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mmio.cpu_irq = (data & 0x80);
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mmio.cpu_ivsw = (data & 0x40);
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mmio.cpu_nvsw = (data & 0x10);
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mmio.cmeg = (data & 0x0f);
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if(mmio.cpu_irq) {
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mmio.cpu_irqfl = true;
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if(mmio.cpu_irqen) {
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mmio.cpu_irqcl = 0;
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cpu.regs.irq = 1;
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}
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}
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}
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//(CIE) SA-1 interrupt enable
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void SA1::mmio_w220a(uint8 data) {
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if(!mmio.sa1_irqen && (data & 0x80) && mmio.sa1_irqfl ) mmio.sa1_irqcl = 0;
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if(!mmio.timer_irqen && (data & 0x40) && mmio.timer_irqfl) mmio.timer_irqcl = 0;
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if(!mmio.dma_irqen && (data & 0x20) && mmio.dma_irqfl ) mmio.dma_irqcl = 0;
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if(!mmio.sa1_nmien && (data & 0x10) && mmio.sa1_nmifl ) mmio.sa1_nmicl = 0;
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mmio.sa1_irqen = (data & 0x80);
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mmio.timer_irqen = (data & 0x40);
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mmio.dma_irqen = (data & 0x20);
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mmio.sa1_nmien = (data & 0x10);
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}
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//(CIC) SA-1 interrupt clear
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void SA1::mmio_w220b(uint8 data) {
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mmio.sa1_irqcl = (data & 0x80);
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mmio.timer_irqcl = (data & 0x40);
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mmio.dma_irqcl = (data & 0x20);
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mmio.sa1_nmicl = (data & 0x10);
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if(mmio.sa1_irqcl) mmio.sa1_irqfl = false;
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if(mmio.timer_irqcl) mmio.timer_irqfl = false;
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if(mmio.dma_irqcl) mmio.dma_irqfl = false;
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if(mmio.sa1_nmicl) mmio.sa1_nmifl = false;
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}
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//(SNV) S-CPU NMI vector
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void SA1::mmio_w220c(uint8 data) { mmio.snv = (mmio.snv & 0xff00) | data; }
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void SA1::mmio_w220d(uint8 data) { mmio.snv = (data << 8) | (mmio.snv & 0xff); }
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//(SIV) S-CPU IRQ vector
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void SA1::mmio_w220e(uint8 data) { mmio.siv = (mmio.siv & 0xff00) | data; }
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void SA1::mmio_w220f(uint8 data) { mmio.siv = (data << 8) | (mmio.siv & 0xff); }
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//(TMC) H/V timer control
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void SA1::mmio_w2210(uint8 data) {
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mmio.hvselb = (data & 0x80);
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mmio.ven = (data & 0x02);
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mmio.hen = (data & 0x01);
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}
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//(CTR) SA-1 timer restart
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void SA1::mmio_w2211(uint8 data) {
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status.vcounter = 0;
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status.hcounter = 0;
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}
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//(HCNT) H-count
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void SA1::mmio_w2212(uint8 data) { mmio.hcnt = (mmio.hcnt & 0xff00) | (data << 0); }
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void SA1::mmio_w2213(uint8 data) { mmio.hcnt = (mmio.hcnt & 0x00ff) | (data << 8); }
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//(VCNT) V-count
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void SA1::mmio_w2214(uint8 data) { mmio.vcnt = (mmio.vcnt & 0xff00) | (data << 0); }
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void SA1::mmio_w2215(uint8 data) { mmio.vcnt = (mmio.vcnt & 0x00ff) | (data << 8); }
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//(CXB) Super MMC bank C
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void SA1::mmio_w2220(uint8 data) {
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mmio.cbmode = (data & 0x80);
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mmio.cb = (data & 0x07);
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}
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//(DXB) Super MMC bank D
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void SA1::mmio_w2221(uint8 data) {
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mmio.dbmode = (data & 0x80);
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|
mmio.db = (data & 0x07);
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}
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//(EXB) Super MMC bank E
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void SA1::mmio_w2222(uint8 data) {
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|
mmio.ebmode = (data & 0x80);
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|
mmio.eb = (data & 0x07);
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}
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//(FXB) Super MMC bank F
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void SA1::mmio_w2223(uint8 data) {
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mmio.fbmode = (data & 0x80);
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mmio.fb = (data & 0x07);
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}
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//(BMAPS) S-CPU BW-RAM address mapping
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void SA1::mmio_w2224(uint8 data) {
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mmio.sbm = (data & 0x1f);
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}
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//(BMAP) SA-1 BW-RAM address mapping
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void SA1::mmio_w2225(uint8 data) {
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mmio.sw46 = (data & 0x80);
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mmio.cbm = (data & 0x7f);
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}
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//(SWBE) S-CPU BW-RAM write enable
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void SA1::mmio_w2226(uint8 data) {
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mmio.swen = (data & 0x80);
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}
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//(CWBE) SA-1 BW-RAM write enable
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void SA1::mmio_w2227(uint8 data) {
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mmio.cwen = (data & 0x80);
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}
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//(BWPA) BW-RAM write-protected area
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void SA1::mmio_w2228(uint8 data) {
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mmio.bwp = (data & 0x0f);
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}
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//(SIWP) S-CPU I-RAM write protection
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void SA1::mmio_w2229(uint8 data) {
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mmio.siwp = data;
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}
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//(CIWP) SA-1 I-RAM write protection
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void SA1::mmio_w222a(uint8 data) {
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mmio.ciwp = data;
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}
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//(DCNT) DMA control
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void SA1::mmio_w2230(uint8 data) {
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mmio.dmaen = (data & 0x80);
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mmio.dprio = (data & 0x40);
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mmio.cden = (data & 0x20);
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mmio.cdsel = (data & 0x10);
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mmio.dd = (data & 0x04);
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mmio.sd = (data & 0x03);
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if(mmio.dmaen == 0) dma.line = 0;
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}
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//(CDMA) character conversion DMA parameters
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void SA1::mmio_w2231(uint8 data) {
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mmio.chdend = (data & 0x80);
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mmio.dmasize = (data >> 2) & 7;
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mmio.dmacb = (data & 0x03);
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if(mmio.chdend) cpubwram.dma = false;
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if(mmio.dmasize > 5) mmio.dmasize = 5;
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if(mmio.dmacb > 2) mmio.dmacb = 2;
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}
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//(SDA) DMA source device start address
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void SA1::mmio_w2232(uint8 data) { mmio.dsa = (mmio.dsa & 0xffff00) | (data << 0); }
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void SA1::mmio_w2233(uint8 data) { mmio.dsa = (mmio.dsa & 0xff00ff) | (data << 8); }
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void SA1::mmio_w2234(uint8 data) { mmio.dsa = (mmio.dsa & 0x00ffff) | (data << 16); }
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//(DDA) DMA destination start address
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void SA1::mmio_w2235(uint8 data) {
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mmio.dda = (mmio.dda & 0xffff00) | (data << 0);
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}
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void SA1::mmio_w2236(uint8 data) {
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mmio.dda = (mmio.dda & 0xff00ff) | (data << 8);
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if(mmio.dmaen == true) {
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if(mmio.cden == 0 && mmio.dd == DMA::DestIRAM) {
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dma_normal();
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} else if(mmio.cden == 1 && mmio.cdsel == 1) {
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dma_cc1();
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}
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}
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}
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void SA1::mmio_w2237(uint8 data) {
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mmio.dda = (mmio.dda & 0x00ffff) | (data << 16);
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|
if(mmio.dmaen == true) {
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if(mmio.cden == 0 && mmio.dd == DMA::DestBWRAM) {
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dma_normal();
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|
}
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}
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}
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//(DTC) DMA terminal counter
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void SA1::mmio_w2238(uint8 data) { mmio.dtc = (mmio.dtc & 0xff00) | (data << 0); }
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void SA1::mmio_w2239(uint8 data) { mmio.dtc = (mmio.dtc & 0x00ff) | (data << 8); }
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//(BBF) BW-RAM bitmap format
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void SA1::mmio_w223f(uint8 data) {
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mmio.bbf = (data & 0x80);
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}
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//(BRF) bitmap register files
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void SA1::mmio_w2240(uint8 data) { mmio.brf[ 0] = data; }
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void SA1::mmio_w2241(uint8 data) { mmio.brf[ 1] = data; }
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void SA1::mmio_w2242(uint8 data) { mmio.brf[ 2] = data; }
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void SA1::mmio_w2243(uint8 data) { mmio.brf[ 3] = data; }
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void SA1::mmio_w2244(uint8 data) { mmio.brf[ 4] = data; }
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void SA1::mmio_w2245(uint8 data) { mmio.brf[ 5] = data; }
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void SA1::mmio_w2246(uint8 data) { mmio.brf[ 6] = data; }
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void SA1::mmio_w2247(uint8 data) { mmio.brf[ 7] = data;
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if(mmio.dmaen == true) {
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if(mmio.cden == 1 && mmio.cdsel == 0) {
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dma_cc2();
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}
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}
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}
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void SA1::mmio_w2248(uint8 data) { mmio.brf[ 8] = data; }
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void SA1::mmio_w2249(uint8 data) { mmio.brf[ 9] = data; }
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void SA1::mmio_w224a(uint8 data) { mmio.brf[10] = data; }
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|
void SA1::mmio_w224b(uint8 data) { mmio.brf[11] = data; }
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|
void SA1::mmio_w224c(uint8 data) { mmio.brf[12] = data; }
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|
void SA1::mmio_w224d(uint8 data) { mmio.brf[13] = data; }
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|
void SA1::mmio_w224e(uint8 data) { mmio.brf[14] = data; }
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|
void SA1::mmio_w224f(uint8 data) { mmio.brf[15] = data;
|
|
if(mmio.dmaen == true) {
|
|
if(mmio.cden == 1 && mmio.cdsel == 0) {
|
|
dma_cc2();
|
|
}
|
|
}
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|
}
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//(MCNT) arithmetic control
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void SA1::mmio_w2250(uint8 data) {
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mmio.acm = (data & 0x02);
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mmio.md = (data & 0x01);
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|
|
if(mmio.acm) mmio.mr = 0;
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|
}
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|
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|
//(MAL) multiplicand / dividend low
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|
void SA1::mmio_w2251(uint8 data) {
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mmio.ma = (mmio.ma & 0xff00) | data;
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|
}
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|
|
|
//(MAH) multiplicand / dividend high
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|
void SA1::mmio_w2252(uint8 data) {
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|
mmio.ma = (data << 8) | (mmio.ma & 0x00ff);
|
|
}
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|
|
|
//(MBL) multiplier / divisor low
|
|
void SA1::mmio_w2253(uint8 data) {
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|
mmio.mb = (mmio.mb & 0xff00) | data;
|
|
}
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|
//(MBH) multiplier / divisor high
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//multiplication / cumulative sum only resets MB
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|
//division resets both MA and MB
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|
void SA1::mmio_w2254(uint8 data) {
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|
mmio.mb = (data << 8) | (mmio.mb & 0x00ff);
|
|
|
|
if(mmio.acm == 0) {
|
|
if(mmio.md == 0) {
|
|
//signed multiplication
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|
mmio.mr = (int16)mmio.ma * (int16)mmio.mb;
|
|
mmio.mb = 0;
|
|
} else {
|
|
//unsigned division
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|
if(mmio.mb == 0) {
|
|
mmio.mr = 0;
|
|
} else {
|
|
int16 quotient = (int16)mmio.ma / (uint16)mmio.mb;
|
|
uint16 remainder = (int16)mmio.ma % (uint16)mmio.mb;
|
|
mmio.mr = (remainder << 16) | quotient;
|
|
}
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|
mmio.ma = 0;
|
|
mmio.mb = 0;
|
|
}
|
|
} else {
|
|
//sigma (accumulative multiplication)
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|
mmio.mr += (int16)mmio.ma * (int16)mmio.mb;
|
|
mmio.overflow = (mmio.mr >= (1ULL << 40));
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|
mmio.mr &= (1ULL << 40) - 1;
|
|
mmio.mb = 0;
|
|
}
|
|
}
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|
|
//(VBD) variable-length bit processing
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|
void SA1::mmio_w2258(uint8 data) {
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|
mmio.hl = (data & 0x80);
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|
mmio.vb = (data & 0x0f);
|
|
if(mmio.vb == 0) mmio.vb = 16;
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|
|
|
if(mmio.hl == 0) {
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|
//fixed mode
|
|
mmio.vbit += mmio.vb;
|
|
mmio.va += (mmio.vbit >> 3);
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|
mmio.vbit &= 7;
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|
}
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|
}
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|
//(VDA) variable-length bit game pak ROM start address
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|
void SA1::mmio_w2259(uint8 data) { mmio.va = (mmio.va & 0xffff00) | (data << 0); }
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|
void SA1::mmio_w225a(uint8 data) { mmio.va = (mmio.va & 0xff00ff) | (data << 8); }
|
|
void SA1::mmio_w225b(uint8 data) { mmio.va = (mmio.va & 0x00ffff) | (data << 16); mmio.vbit = 0; }
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|
//(SFR) S-CPU flag read
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uint8 SA1::mmio_r2300() {
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uint8 data;
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data = mmio.cpu_irqfl << 7;
|
|
data |= mmio.cpu_ivsw << 6;
|
|
data |= mmio.chdma_irqfl << 5;
|
|
data |= mmio.cpu_nvsw << 4;
|
|
data |= mmio.cmeg;
|
|
return data;
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}
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|
//(CFR) SA-1 flag read
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|
uint8 SA1::mmio_r2301() {
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|
uint8 data;
|
|
data = mmio.sa1_irqfl << 7;
|
|
data |= mmio.timer_irqfl << 6;
|
|
data |= mmio.dma_irqfl << 5;
|
|
data |= mmio.sa1_nmifl << 4;
|
|
data |= mmio.smeg;
|
|
return data;
|
|
}
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|
|
|
//(HCR) hcounter read
|
|
uint8 SA1::mmio_r2302() {
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|
//latch counters
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|
mmio.hcr = status.hcounter >> 2;
|
|
mmio.vcr = status.vcounter;
|
|
return mmio.hcr >> 0; }
|
|
uint8 SA1::mmio_r2303() { return mmio.hcr >> 8; }
|
|
|
|
//(VCR) vcounter read
|
|
uint8 SA1::mmio_r2304() { return mmio.vcr >> 0; }
|
|
uint8 SA1::mmio_r2305() { return mmio.vcr >> 8; }
|
|
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//(MR) arithmetic result
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uint8 SA1::mmio_r2306() { return mmio.mr >> 0; }
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uint8 SA1::mmio_r2307() { return mmio.mr >> 8; }
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uint8 SA1::mmio_r2308() { return mmio.mr >> 16; }
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uint8 SA1::mmio_r2309() { return mmio.mr >> 24; }
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uint8 SA1::mmio_r230a() { return mmio.mr >> 32; }
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//(OF) arithmetic overflow flag
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uint8 SA1::mmio_r230b() { return mmio.overflow << 7; }
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//(VDPL) variable-length data read port low
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uint8 SA1::mmio_r230c() {
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uint32 data = (vbr_read(mmio.va + 0) << 0)
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| (vbr_read(mmio.va + 1) << 8)
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| (vbr_read(mmio.va + 2) << 16);
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data >>= mmio.vbit;
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return data >> 0;
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}
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//(VDPH) variable-length data read port high
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uint8 SA1::mmio_r230d() {
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uint32 data = (vbr_read(mmio.va + 0) << 0)
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| (vbr_read(mmio.va + 1) << 8)
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| (vbr_read(mmio.va + 2) << 16);
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data >>= mmio.vbit;
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if(mmio.hl == 1) {
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//auto-increment mode
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mmio.vbit += mmio.vb;
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mmio.va += (mmio.vbit >> 3);
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mmio.vbit &= 7;
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}
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return data >> 8;
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}
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//(VC) version code register
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uint8 SA1::mmio_r230e() {
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return 0x01; //true value unknown
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}
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uint8 SA1::mmio_read(unsigned addr) {
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(co_active() == cpu.thread ? cpu.synchronize_coprocessors() : synchronize_cpu());
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addr &= 0xffff;
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switch(addr) {
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case 0x2300: return mmio_r2300();
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case 0x2301: return mmio_r2301();
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case 0x2302: return mmio_r2302();
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case 0x2303: return mmio_r2303();
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|
case 0x2304: return mmio_r2304();
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|
case 0x2305: return mmio_r2305();
|
|
case 0x2306: return mmio_r2306();
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|
case 0x2307: return mmio_r2307();
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|
case 0x2308: return mmio_r2308();
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|
case 0x2309: return mmio_r2309();
|
|
case 0x230a: return mmio_r230a();
|
|
case 0x230b: return mmio_r230b();
|
|
case 0x230c: return mmio_r230c();
|
|
case 0x230d: return mmio_r230d();
|
|
case 0x230e: return mmio_r230e();
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|
}
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return 0x00;
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}
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void SA1::mmio_write(unsigned addr, uint8 data) {
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(co_active() == cpu.thread ? cpu.synchronize_coprocessors() : synchronize_cpu());
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addr &= 0xffff;
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switch(addr) {
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case 0x2200: return mmio_w2200(data);
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case 0x2201: return mmio_w2201(data);
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case 0x2202: return mmio_w2202(data);
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case 0x2203: return mmio_w2203(data);
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|
case 0x2204: return mmio_w2204(data);
|
|
case 0x2205: return mmio_w2205(data);
|
|
case 0x2206: return mmio_w2206(data);
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case 0x2207: return mmio_w2207(data);
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case 0x2208: return mmio_w2208(data);
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|
case 0x2209: return mmio_w2209(data);
|
|
case 0x220a: return mmio_w220a(data);
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|
case 0x220b: return mmio_w220b(data);
|
|
case 0x220c: return mmio_w220c(data);
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case 0x220d: return mmio_w220d(data);
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|
case 0x220e: return mmio_w220e(data);
|
|
case 0x220f: return mmio_w220f(data);
|
|
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case 0x2210: return mmio_w2210(data);
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|
case 0x2211: return mmio_w2211(data);
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|
case 0x2212: return mmio_w2212(data);
|
|
case 0x2213: return mmio_w2213(data);
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|
case 0x2214: return mmio_w2214(data);
|
|
case 0x2215: return mmio_w2215(data);
|
|
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|
case 0x2220: return mmio_w2220(data);
|
|
case 0x2221: return mmio_w2221(data);
|
|
case 0x2222: return mmio_w2222(data);
|
|
case 0x2223: return mmio_w2223(data);
|
|
case 0x2224: return mmio_w2224(data);
|
|
case 0x2225: return mmio_w2225(data);
|
|
case 0x2226: return mmio_w2226(data);
|
|
case 0x2227: return mmio_w2227(data);
|
|
case 0x2228: return mmio_w2228(data);
|
|
case 0x2229: return mmio_w2229(data);
|
|
case 0x222a: return mmio_w222a(data);
|
|
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|
case 0x2230: return mmio_w2230(data);
|
|
case 0x2231: return mmio_w2231(data);
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|
case 0x2232: return mmio_w2232(data);
|
|
case 0x2233: return mmio_w2233(data);
|
|
case 0x2234: return mmio_w2234(data);
|
|
case 0x2235: return mmio_w2235(data);
|
|
case 0x2236: return mmio_w2236(data);
|
|
case 0x2237: return mmio_w2237(data);
|
|
case 0x2238: return mmio_w2238(data);
|
|
case 0x2239: return mmio_w2239(data);
|
|
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|
case 0x223f: return mmio_w223f(data);
|
|
case 0x2240: return mmio_w2240(data);
|
|
case 0x2241: return mmio_w2241(data);
|
|
case 0x2242: return mmio_w2242(data);
|
|
case 0x2243: return mmio_w2243(data);
|
|
case 0x2244: return mmio_w2244(data);
|
|
case 0x2245: return mmio_w2245(data);
|
|
case 0x2246: return mmio_w2246(data);
|
|
case 0x2247: return mmio_w2247(data);
|
|
case 0x2248: return mmio_w2248(data);
|
|
case 0x2249: return mmio_w2249(data);
|
|
case 0x224a: return mmio_w224a(data);
|
|
case 0x224b: return mmio_w224b(data);
|
|
case 0x224c: return mmio_w224c(data);
|
|
case 0x224d: return mmio_w224d(data);
|
|
case 0x224e: return mmio_w224e(data);
|
|
case 0x224f: return mmio_w224f(data);
|
|
|
|
case 0x2250: return mmio_w2250(data);
|
|
case 0x2251: return mmio_w2251(data);
|
|
case 0x2252: return mmio_w2252(data);
|
|
case 0x2253: return mmio_w2253(data);
|
|
case 0x2254: return mmio_w2254(data);
|
|
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|
case 0x2258: return mmio_w2258(data);
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|
case 0x2259: return mmio_w2259(data);
|
|
case 0x225a: return mmio_w225a(data);
|
|
case 0x225b: return mmio_w225b(data);
|
|
}
|
|
}
|
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#endif
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